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参数资料
| 型号： | ML53812-2 |
| 厂商： | OKI ELECTRIC INDUSTRY CO LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | SPECIALTY MICROPROCESSOR CIRCUIT, PQFP176 |
| 封装： | LQFP-176 |
| 文件页数： | 13/64页 |
| 文件大小： | 668K |
| 代理商： | ML53812-2 |
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s ML53812-2 s ––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––––
16
Oki Semiconductor
6.4 Configuration Registers
Note: All "Reserved" configuration registers should be written "0".
Configuration Register Byte 0, AR = 0000h
DR_0
C
Definition
0
Diagnostic Mode
1
Test Mode
2
APLL Power-down Mode
3
APLL Bypass Mode
[7:4]
APLL CLKREF Frequency [3:0]
Diagnostic Mode (C_ [0]) (Read/Write)
Set to 0 for normal operation
0
→
Diagnostic Mode Disabled
1
→
Diagnostic Mode Enabled (Default)
Test Mode (C_ [1]) (Read/Write)
Enables testing with the slave DPLL bypassed. Set to 0 for normal operation.
0
→
Test Mode Disabled (Default)
1
→
Test Mode Enabled
APLL Power-down Mode (C_ [2]) (Read/Write)
Powers down analog PLL, resets APLL charge pump. Set to 0 for normal operation.
0
→
APLL Power-down Mode Disabled
1
→
APLL Power-down Mode Enabled (Default)
APLL Bypass Mode (C_ [3]) (Read/Write)
APLL Bypass used during simulation and testing. Set to 0 for normal operation.
0
→
APLL Bypass Mode Disabled
1
→
APLL Bypass Mode Enabled (Default)
APLL CLKREF Frequency [3:0] (C_ [7:4]) (Read/Write)
Put APLL in Power-down (C_[2] = 1) when changing APLL CLKREF Frequency.
0h
→
65.536 MHz (32 X 2.048 MHz) (Default)
1h
→
49.152 MHz (24 X 2.048 MHz)
2h
→
32.768 MHz (16 X 2.048 MHz)
3h
→
16.384 MHz (8 X 2.048 MHz)
4h
→
8.192 MHz (4 X 2.048 MHz)
5h
→
4.096 MHz (2 X 2.048 MHz)
6h
→
2.048 MHz
7h - fh
→
Reserved
相关PDF资料 |
PDF描述 |
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参数描述 |
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