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参数资料
| 型号： | ML63512A-XXXWA |
| 厂商： | OKI ELECTRIC INDUSTRY CO LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 4-BIT, MROM, 2 MHz, MICROCONTROLLER, UUC60 |
| 封装： | 3.51 X 3.77 MM, DIE-60 |
| 文件页数： | 189/250页 |
| 文件大小： | 1326K |
| 代理商： | ML63512A-XXXWA |
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3-2
ML63512A/514A User's Manual
Chapter 3 CPU Control Functions
3.2 System Reset Mode (RST)
3.2.1 Transfer to and State of System Reset Mode
The following one factor causes a transfer to the system reset mode.
Setting the RESETB pin to a "L" level
Since the ML63512A/514A have an internal reset sampling (32 kHz) circuit, keep the
RESETB pin (pulse width) set to a "L" level for 1.25 seconds or more.
The following operations are performed in the system reset mode.
(1) CPU is initialized.
(2) Backup flag changes to "1" and backup circuit changes to ON state.
(3) Bias reference voltage supply (VR) is energized.
(4) All special function registers (SFRs) are initialized. However, data RAM is not initialized.
After system reset processing, instruction execution begins from address 0000H.
Figures 3-2 and 3-3 show the system reset generator circuit and signals when a system reset
is generated.
Whether the internal pull-up resistor is selected or whether the external pull-up resistor is
used is specified by the mask option.
Figure 3-3 Signals When System Reset is Generated
! Note:
System reset takes priority over all other processing and terminates all processing up to that
point in time. Therefore, the content of RAM, which is not initialized, cannot be guaranteed
after a system reset.
Figure 3-2 System Reset Generator Circuit
RESETB
R
Q
RESET0
(Time base
counter reset)
Sampling
circuit
RESETS
(System reset)
1/8192 TBC
(4 Hz @ 32.768 kHz)
S
32 kHz
VDD
(Mask option)
RESETB
Low-speed clock
RESETS
Backup
(30 k to 80 kHz)
4096 clocks
(125 ms @ 32.768 kHz)
ON
CPU start
2048 clocks
(62.5 ms @ 32.768 kHz)
1.25 sec. or more
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PDF描述 |
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