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参数资料
| 型号： | ML63514A-XXXTP |
| 厂商： | OKI ELECTRIC INDUSTRY CO LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 4-BIT, MROM, 2 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | PLASTIC, TQFP-64 |
| 文件页数： | 191/250页 |
| 文件大小： | 1326K |
| 代理商： | ML63514A-XXXTP |
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3-4
ML63512A/514A User's Manual
Chapter 3 CPU Control Functions
3.3.2 Halt Mode Release
The following two methods are available to release the halt mode.
Release by interrupt generation (transfer to normal operation mode)
Release by RESETB pin (transfer to system reset mode)
3.3.2.1 Release of Halt Mode by Interrupt
If the halt mode is to be released by an interrupt, the enable flag of the interrupt used for
release must be set to "1" prior to entering the halt mode. When the halt mode is released by
an interrupt, operation transfers to the normal operation mode.
Figure 3-5 shows the timing of transferring to the halt mode by execution of a HALT instruction
and of releasing the halt mode by an interrupt.
When the halt mode is released by an interrupt request, the first instruction immediately
following the HALT instruction is executed and then the interrupt routine is entered. When an
RTI instruction is used to complete the interrupt routine, the main routine is resumed
beginning from the second instruction after the HALT instruction.
Figure 3-5 Timing of Transfer to Halt Mode and Release of Halt Mode by Interrupt
! Note:
If the halt mode is to be released, set individual interrupt enable flags to "1". If an individual
interrupt enable flag is "0", the corresponding interrupt request signal cannot reset the HLT
flag, regardless of whether the master interrupt enable flag (MIE) is "0" or "1".
3.3.2.2 Release of Halt Mode by RESETB Pin
If a low-level is input to the RESETB pin (a pulse width of 1.25 seconds or more), the CPU
is released from the halt mode and transfers to the system reset mode.
S1
S2
S1
S2
S1
S2
S1
S2
S1
S2
S1
S2
S1
S2
S1
S2
HALT
HLT (halt flag)
Interrupt request
INT
PC flow in main
routine
: HALT instruction address
: Starting address of interrupt routine
: RTI instruction address
HALT
instruction
execution
Halt mode
RTI
instruction
execution
Main
routine
Interrupt
routine
System clock
n
(RTI)
n+2
n+1
(INT)
n
(INT)
(RTI)
Execution of
instruction
immediately after
HALT instruction
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PDF描述 |
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