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参数资料
| 型号： | ML63514A-XXXTP |
| 厂商： | OKI ELECTRIC INDUSTRY CO LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 4-BIT, MROM, 2 MHz, MICROCONTROLLER, PQFP64 |
| 封装： | PLASTIC, TQFP-64 |
| 文件页数： | 247/250页 |
| 文件大小： | 1326K |
| 代理商： | ML63514A-XXXTP |
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7-15
ML63512A/514A User's Manual
Chapter 7 Timers (TIMER)
7
The operation procedure is listed below.
q Set P1.0/TM0CAP to input mode, and enable XI0INT and TM0INT.
w Clear all bits of the timer counter registers and timer data registers to "0".
e Set TM0CON0 to the capture mode, and set TM0RUN to "1" to begin upward
counting.
r If the P1.0/TM0CAP input changes, the TM0CH/TM0CL value is captured by
TM0DH/TM0DL and TM0CAP is set to "1" (first capture). The CPU detects this
through XI0INT and reads the values of TM0DH/TM0DL.
t After the TM0DH/TM0DL read is complete, TM0CAP is cleared to "0" to wait for
the next capture.
y If the P1.0/TM0CAP input changes, repeat operations r and t (second capture).
The high-level pulse width t1 of the P1.0 input can be determined as follows.
t1 = (F0H – 50H)
tCLK
tCLK: TMCLK cycle
u TM0INT is generated when the timer counter register overflows. When overflow
occurs, the timer counter register changes from FFH to 00H and continues upward
counting.
i If the P1.0/TM0CAP input changes, repeat operations r and t (third capture).
Because the counter overflows once during the interval between the second
capture and the third capture, the low-level pulse width t2 of the P1.0 input can be
determined as follows.
t2 = (60H – F0H + 100H)
tCLK
o While TM0CAP = "1", there is no capture even when P1.0/TM0CAP changes.
Figure 7-9 shows the capture timing and Figure 7-10 shows the capture signal (CAPT)
generator circuit.
m+5
m+4
m+3
m+2
m+1
m
m+6
m+7
m+8
m+1
Timer clock
P1.0/TM0CAP input
TM0CH, TM0CL
TM0DH, TM0DL
Capture signal
(CAPT)
TM0CAP
TM0STAT READ
Figure 7-9 Capture Timing
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