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参数资料
| 型号： | MM908E624ACDWB/R |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO54 |
| 封装： | PLASTIC, SOIC-54 |
| 文件页数： | 4/34页 |
| 文件大小： | 714K |
| 代理商： | MM908E624ACDWB/R |
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Analog Integrated Circuit Device Data
12
Freescale Semiconductor
908E624
Dynamic Electrical Characteristics
DYNAMIC ELECTRICAL CHARACTERISTICS
Table 4. Dynamic Electrical Characteristics
All characteristics are for the analog chip only. Please refer to the 68HC908EY16 datasheet for characteristics of the
microcontroller chip. Characteristics noted under conditions 9.0 V ≤ VSUP ≤ 16 V, -40°C ≤ TJ ≤ 125°C unless otherwise noted.
Typical values noted reflect the approximate parameter mean at TA = 25°C under nominal conditions unless otherwise noted.
Characteristic
Symbol
Min
Typ
Max
Unit
LIN Physical Layer
Driver Characteristics for Normal Slew Rate (20), (21)
Dominant Propagation Delay TXD to LIN
tDOM-MIN
——
50
s
Dominant Propagation Delay TXD to LIN
tDOM-MAX
——
50
s
Recessive Propagation Delay TXD to LIN
tREC-MIN
——
50
s
Recessive Propagation Delay TXD to LIN
tREC-MAX
——
50
s
Propagation Delay Symmetry: tDOM-MIN - tREC-MAX
dt1
-10.44
—
s
Propagation Delay Symmetry: tDOM-MAX - tREC-MIN
dt2
—
11
s
Dominant Propagation Delay TXD to LIN
tDOM-MIN
—
100
s
Dominant Propagation Delay TXD to LIN
tDOM-MAX
—
100
s
Recessive Propagation Delay TXD to LIN
tREC-MIN
—
100
s
Recessive Propagation Delay TXD to LIN
tREC-MAX
—
100
s
Propagation Delay Symmetry: tDOM-MIN - tREC-MAX
dt1s
-22
—
s
Propagation Delay Symmetry: tDOM-MAX - tREC-MIN
dt2s
—
23
s
Driver Characteristics for Fast Slew Rate
LIN High Slew Rate (Programming Mode)
SRFAST
—15
—
V/
s
Receiver Characteristics and Wake-Up Timings
Receiver Dominant Propagation Delay (23)
tRL
—3.5
6.0
s
Receiver Recessive Propagation Delay (23)
tRH
—3.5
6.0
s
Receiver Propagation Delay Symmetry
tR-SYM
-2.0
—
2.0
s
Bus Wake-Up Deglitcher
tPROPWL
35
80
s
Bus Wake-Up Event Reported (24)
tWAKE
—20
—
s
Notes
20.
VSUP from 7.0 V to 18 V, bus load R0 and C0 1.0 nF/1.0 k, 6.8 nF/660 , 10 nF/500 . Measurement thresholds: 50% of TXD signal
to LIN signal threshold defined at each parameter.
21.
22.
23.
Measured between LIN signal threshold VIL or VIH and 50% of RXD signal.
24.
tWAKE is typically 2 internal clock cycles after LIN rising edge detected. See Figure 8 and Figure 9, page 17. In Sleep mode the VDD
rise time is strongly dependent upon the decoupling capacitor at VDD terminal.
相关PDF资料 |
PDF描述 |
|---|---|
| MM908E625ACDWB | 8-BIT, FLASH, 8 MHz, MICROCONTROLLER, PDSO54 |
| MMBD1010LT3 | 0.2 A, 2 ELEMENT, SILICON, SIGNAL DIODE, TO-236AB |
| MMBD3000T1 | 0.2 A, SILICON, SIGNAL DIODE |
| MMBD1000LT3 | 0.2 A, SILICON, SIGNAL DIODE, TO-236AB |
| MMBD3005T1 | 0.2 A, 2 ELEMENT, SILICON, SIGNAL DIODE |
相关代理商/技术参数 |
参数描述 |
|---|---|
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