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参数资料
| 型号： | MPC5123VY400BR |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | RISC PROCESSOR, PBGA516 |
| 封装： | 27 X 27 MM, ROHS COMPLIANT, PLASTIC, TFBGA-516 |
| 文件页数： | 49/86页 |
| 文件大小： | 1266K |
| 代理商： | MPC5123VY400BR |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页当前第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页
Electrical and Thermal Characteristics
MPC5121E/MPC5123 Data Sheet, Rev. 1
Freescale Semiconductor
53
3.3.9.5
UDMA Out Timing Diagrams
UDMA mode timing is more complicated than PIO mode or MDMA mode. In this section, timing diagrams for UDMA out are
given:
Figure 31 gives timing for UDMA out transfer start
Figure 32 gives timing for host terminating UDMA out transfer
Figure 33 gives timing for device terminating UDMA out transfer.
Table 29. Timing Parameters UDMA in Burst
ATA
Parameter
UDMA In
Timing
Parameter
Value
How to Meet
SpecID
tack
tack(min) = (time_ack * T) – (tskew1 + tskew2 )
calculate and
programming time_ack,
see Reference Manual
A9.51
tenv
tenv(min) = (time_env * T) – (tskew1 + tskew2)
tenv(max) = (time_env * T) + (tskew1 + tskew2)
calculate and
programming time_env,
see Reference Manual
A9.52
tds
tds1
tds – (tskew3) – ti_ds > 0
tskew3, ti_ds, ti_dh
should be low enough
A9.53
tdh
tdh1
tdh – (tskew3) –ti_dh > 0
A9.54
tcyc
tc1
(tcyc – tskew ) > T
Bus clock period T big
enough
A9.55
trp
trp(min) = time_rp * T – (tskew1 + tskew2 + tskew6)
calculate and
programming time_rp,
see Reference Manual
A9.56
—
tx11
1 There is a special timing requirement in the ATA host that requires the internal DIOW to go only high three clocks after the
last active edge on the DSTROBE signal. The equation given on this line tries to capture this constraint.
(time_rp * T) – (tco + tsu + 3T + 2 *tbuf + 2*tcable2) > trfs
(drive)
calculate and
programming time_rp,
see Reference Manual
A9.57
tmli
tmli1
tmli1(min) = (time_mlix + 0.4) * T
calculate and
programming time_mlix,
see Reference Manual
A9.58
tzah
tzah(min) = (time_zah + 0.4) * T
calculate and
programming time_zah,
see Reference Manual
A9.59
tdzfs
tdzfs = (time_dzfs * T) – (tskew1 + tskew2)
calculate and
programming time_dzfs,
see Reference Manual
A9.60
tcvh
tcvh = (time_cvh *T) – (tskew1 + tskew2)
calculate and
programming time_cvh,
see Reference Manual
A9.61
—
ton
toff2
2 Make TON and TOFF big enough to avoid bus contention.
ton = time_on * T – tskew1
toff = time_off * T – tskew1
—
A9.62
Preliminary
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PDF描述 |
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参数描述 |
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| MPC5123YVY300BR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Advance Information |
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| MPC5123YVY400BR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:e300 Power Architecture processor core |
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