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参数资料
| 型号： | MPC5607BF0ACMG6R |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 64 MHz, MICROCONTROLLER, PBGA208 |
| 封装： | 17 X 17 MM, 1 MM PITCH, MO-152AAF-1, ROHS COMPLIANT, MAPBGA-208 |
| 文件页数： | 96/110页 |
| 文件大小： | 907K |
| 代理商： | MPC5607BF0ACMG6R |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页当前第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页
MPC5607B
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Fre
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scale
Semico
nductor
86
9tSUI
SR D Data setup time for inputs
Master mode
43
—
145
—
ns
Slave mode
5
—
5
—
10
tHI
SR D Data hold time for inputs
Master mode
0
—
0
—
ns
Slave mode
26
——
——
11
tSUO
7
CC D Data valid after SCK edge Master mode
—
32
—
50
ns
Slave mode
—
52
—
160
12
tHO
CC D Data hold time for outputs
Master mode
0
—
0
—
ns
Slave mode
8
—
13
—
1 Operating conditions: C
L = 10 to 50 pF, SlewIN = 3.5 to 15 ns
2 Maximum value is reached when CSn pad is configured as SLOW pad while SCK pad is configured as MEDIUM. A positive value means that SCK
starts before CSn is asserted. DSPI2 has only SLOW SCK available.
3 Maximum value is reached when CSn pad is configured as MEDIUM pad while SCK pad is configured as SLOW. A positive value means that CSn is
deasserted before SCK. DSPI0 and DSPI1 have only MEDIUM SCK available.
4 The t
CSC delay value is configurable through a register. When configuring tCSC (using PCSSCK and CSSCK fields in DSPI_CTARx registers), delay
between internal CS and internal SCK must be higher than
t
CSC to ensure positive tCSCext.
5 The t
ASC delay value is configurable through a register. When configuring tASC (using PASC and ASC fields in DSPI_CTARx registers), delay between
internal CS and internal SCK must be higher than
t
ASC to ensure positive tASCext.
6 This delay value corresponds to SMPL_PT = 00b which is bit field 9 and 8 of DSPI_MCR register.
7 SCK and SOUT are configured as MEDIUM pad.
Table 47. DSPI characteristics1 (continued)
No.
Symbol
C
Parameter
DSPI0/DSPI1/DSPI5/DSPI6
DSPI2/DSPI4
Unit
Min
Typ
Max
Min
Typ
Max
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| MPC5607CECLLR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Microcontroller |
| MPC5607CECLQR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Microcontroller |
| MPC5607CECLUR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Microcontroller |
| MPC5607CEMLLR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Microcontroller |
| MPC5607CEMLQR | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:Microcontroller |
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