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参数资料
| 型号： | MPC8313E-RDBC |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 42/99页 |
| 文件大小： | 0K |
| 描述： | BOARD CPU 8313E VER 2.2 |
| 标准包装： | 1 |
| 系列： | PowerQUICC II™ PRO |
| 类型： | MPU |
| 适用于相关产品： | MPC8313E |
| 所含物品： | 板 |
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MPC8313E PowerQUICC II Pro Processor Hardware Specifications, Rev. 4
Freescale Semiconductor
47
11 Enhanced Local Bus
This section describes the DC and AC electrical specifications for the local bus interface.
11.1 Local Bus DC Electrical Characteristics
This table provides the DC electrical characteristics for the local bus interface.
11.2
Local Bus AC Electrical Specifications
This table describes the general timing parameters of the local bus interface.
Table 44. Local Bus DC Electrical Characteristics at 3.3 V
Parameter
Symbol
Min
Max
Unit
High-level input voltage for Rev 1.0
VIH
2.0
LVDD + 0.3
V
High-level input voltage for Rev 2.x or later
VIH
2.1
LVDD + 0.3
V
Low-level input voltage
VIL
–0.3
0.8
V
Input current, (VIN
1 = 0 V or V
IN = LVDD)IIN
—
±5
A
High-level output voltage, (LVDD = min, IOH = –2 mA)
VOH
LVDD – 0.2
—
V
Low-level output voltage, (LVDD = min, IOH = 2 mA)
VOL
—0.2
V
Note: The parameters stated in above table are valid for all revisions unless explicitly mentioned.
Table 45. Local Bus General Timing Parameters
Parameter
Symbol1
Min
Max
Unit
Note
Local bus cycle time
tLBK
15
—
ns
2
Input setup to local bus clock
tLBIVKH
7
—
ns
3, 4
Input hold from local bus clock
tLBIXKH
1.0
—
ns
3, 4
LALE output fall to LAD output transition (LATCH hold time)
tLBOTOT1
1.5
—
ns
5
LALE output fall to LAD output transition (LATCH hold time)
tLBOTOT2
3—
ns
6
LALE output fall to LAD output transition (LATCH hold time)
tLBOTOT3
2.5
—
ns
7
LALE output rise to LCLK negative edge
tLALEHOV
—3.0
ns
LALE output fall to LCLK negative edge
tLALETOT1
–1.5
—
ns
5
LALE output fall to LCLK negative edge
tLALETOT2
–5.0
—
ns
6
LALE output fall to LCLK negative edge
tLALETOT3
–4.5
—
ns
7
Local bus clock to output valid
tLBKHOV
—3
ns
3
Local bus clock to output high impedance for LAD
tLBKHOZ
—4
ns
8
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参数描述 |
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