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参数资料
型号： MPC8544AVTARJ
厂商： Freescale Semiconductor
文件页数： 23/117页
文件大小： 0K
描述： IC MPU POWERQUICC III 783-FCBGA
产品培训模块： MPC8544E PowerQUICC™ III
标准包装： 1
系列： MPC85xx
处理器类型： 32-位 MPC85xx PowerQUICC III
速度： 1.067GHz
电压： 0.95 V ~ 1.05 V
安装类型： 表面贴装
封装/外壳： 783-BBGA，FCBGA
供应商设备封装： 783-FCPBGA（29x29）
包装： 托盘
配用： MPC8544DS-ND - BOARD DEVELOPMENT SYSTEM 8544
MPC8544E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 6
Freescale Semiconductor
13
Power Characteristics
3
Power Characteristics
The estimated typical core power dissipation for the core complex bus (CCB) versus the core frequency
for this family of PowerQUICC III devices is shown in Table 4.
4
Input Clocks
This section contains the following subsections:
Section 4.1, “System Clock Timing”
Section 4.2, “Real-Time Clock Timing”
Section 4.3, “eTSEC Gigabit Reference Clock Timing”
Section 4.4, “Platform to FIFO Restrictions”
Section 4.5, “Other Input Clocks”
Table 4. MPC8544ECore Power Dissipation
Power Mode
Core Frequency
(MHz)
Platform Frequency
(MHz)
VDD
(V)
Junction
Temperature (
° C)
Power
(W)
Notes
Typical
667
333
1.0
65
2.6
1, 2
Thermal
105
4.5
1, 3
Maximum
7.15
1, 4
Typical
800
400
1.0
65
2.9
1, 2
Thermal
105
4.8
1, 3
Maximum
7.35
1, 4
Typical
1000
400
1.0
65
3.6
1, 2
Thermal
105
5.3
1, 3
Maximum
7.5
1, 4
Typical
1067
533
1.0
65
3.9
1, 2
Thermal
105
6.0
1, 3
Maximum
7.7
1, 4
Notes:
1. These values specify the power consumption at nominal voltage and apply to all valid processor bus frequencies and
configurations. The values do not include power dissipation for I/O supplies.
2. Typical power is an average value measured at the nominal recommended core voltage (VDD) and 65° C junction temperature
(see Table 2) while running the Dhrystone 2.1 benchmark.
3. Thermal power is the average power measured at nominal core voltage (VDD) and maximum operating junction temperature
(see Table 2) while running the Dhrystone 2.1 benchmark.
4. Maximum power is the maximum power measured at nominal core voltage (VDD) and maximum operating junction
temperature (see Table 2) while running a smoke test which includes an entirely L1-cache-resident, contrived sequence of
instructions which keep the execution unit maximally busy.
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