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参数资料
| 型号： | MPC8569ECVTANKGB |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | RISC PROCESSOR, PBGA783 |
| 封装： | 29 X 29 MM, 1 MM PITCH, PLASTIC, BGA-783 |
| 文件页数： | 62/126页 |
| 文件大小： | 2847K |
| 代理商： | MPC8569ECVTANKGB |
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MPC8569E PowerQUICC III Integrated Processor Hardware Specifications, Rev. 0
Overall DC Electrical Characteristics
Freescale Semiconductor
40
2.1.1.2
Output Driver Characteristics
The following table provides information on the characteristics of the output driver strengths. The values are preliminary
estimates.
2.1.2
Power Sequencing
The MPC8569E requires its power rails to be applied in a specific sequence to ensure proper device operation. These
requirements are as follows for power up:
1.
VDD, AVDD_n, BVDD, LVDDn, OVDD, ScoreVDD, XVDD
2.
GVDD
All supplies must be at their stable values within 50 ms.
Items on the same line have no ordering requirement with respect to one another. Items on separate lines must be ordered
sequentially such that voltage rails on a previous step must reach 90% of their value before the voltage rails on the current step
reach 10% of theirs.
NOTE
While VDD is ramping, current may be supplied from VDD through the MPC8569E to
GVDD. Nevertheless, GVDD from an external supply should follow the sequencing
described above.
From a system standpoint, if any of the I/O power supplies ramp prior to the VDD core supply, the I/Os associated with that I/O
supply may drive a logic one or zero during power up, and extra current may be drawn by the device.
2.1.3
RESET Initialization
This section describes the AC electrical specifications for the RESET timing requirements of the MPC8569E. The following
table describes the specifications for the RESET initialization timing.
Table 4. Output Drive Capability
Driver Type
Programmable Output Impedance (
Ω)
Supply Voltage
Notes
Enhanced local bus interface utilities signals
45
BVDD = 3.3 V
BVDD = 2.5 V
BVDD = 1.8 V
—
DDR2 signal
18 (full strength mode)
35 (half strength mode)
GVDD = 1.8 V
1
DDR3 signal
20 (full strength mode)
40 (half strength mode)
GVDD = 1.5 V
1
DUART, EPIC, I2C, JTAG, system control
45
OVDD = 3.3 V
—
Note:
1. The drive strength of the DDR2 or DDR3 interface in half-strength mode is at TJ = 105° C and at GVDD (min). Refer to the
MPC8569 reference manual for the DDR impedance programming procedure through the DDR control driver register 1
(DDRCDR_1).
Table 5. RESET Initialization Timing Specifications
Parameter
Min
Max
Unit
Notes
Required assertion time of HRESET
10
—
SYSCLK
1, 2
Minimum assertion time of TRESET simultaneous to HRESET assertion
25
—
ns
3
相关PDF资料 |
PDF描述 |
|---|---|
| MPC8569ECVTANKG | RISC PROCESSOR, PBGA783 |
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相关代理商/技术参数 |
参数描述 |
|---|---|
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| MPC8569E-MDS-PB | 功能描述:开发板和工具包 - 其他处理器 MPC8569 MDS PROCESSOR BD RoHS:否 制造商:Freescale Semiconductor 产品:Development Systems 工具用于评估:P3041 核心:e500mc 接口类型:I2C, SPI, USB 工作电源电压: |
| MPC8569EVTANKGB | 功能描述:数字信号处理器和控制器 - DSP, DSC 8569 800MHz rev2.1 RoHS:否 制造商:Microchip Technology 核心:dsPIC 数据总线宽度:16 bit 程序存储器大小:16 KB 数据 RAM 大小:2 KB 最大时钟频率:40 MHz 可编程输入/输出端数量:35 定时器数量:3 设备每秒兆指令数:50 MIPs 工作电源电压:3.3 V 最大工作温度:+ 85 C 封装 / 箱体:TQFP-44 安装风格:SMD/SMT |
| MPC8569EVTAQLJB | 功能描述:数字信号处理器和控制器 - DSP, DSC 8569 1GHz rev2.1 RoHS:否 制造商:Microchip Technology 核心:dsPIC 数据总线宽度:16 bit 程序存储器大小:16 KB 数据 RAM 大小:2 KB 最大时钟频率:40 MHz 可编程输入/输出端数量:35 定时器数量:3 设备每秒兆指令数:50 MIPs 工作电源电压:3.3 V 最大工作温度:+ 85 C 封装 / 箱体:TQFP-44 安装风格:SMD/SMT |
| MPC8569EVTAUNLB | 功能描述:数字信号处理器和控制器 - DSP, DSC 8569 1.33GHz rev2.1 RoHS:否 制造商:Microchip Technology 核心:dsPIC 数据总线宽度:16 bit 程序存储器大小:16 KB 数据 RAM 大小:2 KB 最大时钟频率:40 MHz 可编程输入/输出端数量:35 定时器数量:3 设备每秒兆指令数:50 MIPs 工作电源电压:3.3 V 最大工作温度:+ 85 C 封装 / 箱体:TQFP-44 安装风格:SMD/SMT |
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