参数资料
型号: MPC870VR80
厂商: FREESCALE SEMICONDUCTOR INC
元件分类: 微控制器/微处理器
英文描述: 32-BIT, 80 MHz, RISC PROCESSOR, PBGA256
封装: LEAD FREE, PLASTIC, BGA-256
文件页数: 63/84页
文件大小: 1042K
代理商: MPC870VR80
MPC875/MPC870 PowerQUICC Hardware Specifications, Rev. 4
66
Freescale Semiconductor
CPM Electrical Characteristics
Table 29 provides the I2C (SCL > 100 kHz) timings.
Figure 64 shows the I2C bus timing.
Figure 64. I2C Bus Timing Diagram
210
SDL/SCL fall time
300
ns
211
Stop condition setup time
4.7
μs
1 SCL frequency is given by SCL = BRGCLK_frequency/((BRG register + 3) × pre_scalar × 2).
The ratio SYNCCLK/(BRGCLK/pre_scalar) must be greater than or equal to 4/1.
Table 29. I2C Timing (SCL > 100 kHZ)
Num
Characteristic
Expression
All Frequencies
Unit
Min
Max
200
SCL clock frequency (slave)
fSCL
0
BRGCLK/48
Hz
200
SCL clock frequency (master)1
1 SCL frequency is given by SCL = BRGCLK_frequency/((BRG register + 3) × pre_scalar × 2).
The ratio SYNCCLK/(BRGCLK/pre_scalar) must be greater than or equal to 4/1.
fSCL
BRGCLK/16512
BRGCLK/48
Hz
202
Bus free time between transmissions
1/(2.2
× fSCL)
s
203
Low period of SCL
1/(2.2
× fSCL)
s
204
High period of SCL
1/(2.2
× fSCL)
s
205
Start condition setup time
1/(2.2
× fSCL)
s
206
Start condition hold time
1/(2.2
× fSCL)
s
207
Data hold time
0
s
208
Data setup time
1/(40
× fSCL)
s
209
SDL/SCL rise time
1/(10
× fSCL)
s
210
SDL/SCL fall time
1/(33
× fSCL)
s
211
Stop condition setup time
1/2(2.2
× fSCL)
s
Table 28. I2C Timing (SCL < 100 kHZ) (continued)
Num
Characteristic
All Frequencies
Unit
Min
Max
SCL
202
205
203
207
204
208
206
209
211
210
SDA
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