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参数资料
| 型号： | MPC9449AER2 |
| 厂商： | IDT, Integrated Device Technology Inc |
| 文件页数： | 10/11页 |
| 文件大小： | 0K |
| 描述： | IC CLK BUFF DVDR MUX 3:15 52LQFP |
| 标准包装： | 1,500 |
| 类型： | 扇出缓冲器（分配），除法器，多路复用器 |
| 电路数： | 1 |
| 比率 - 输入:输出： | 3:15 |
| 差分 - 输入:输出： | 是/无 |
| 输入： | LVCMOS，LVPECL |
| 输出： | LVCMOS |
| 频率 - 最大： | 200MHz |
| 电源电压： | 2.375 V ~ 3.465 V |
| 工作温度： | -40°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 52-LQFP |
| 供应商设备封装： | 52-TQFP（10x10） |
| 包装： | 带卷 (TR) |
MPC9449 REVISION 6 DECEMBER 21, 2012
8
2012 Integrated Device Technology, Inc.
MPC9449 Data Sheet
3.3V/2.5V 1:15 PECL/LVCMOS CLOCK FANOUT BUFFER
Figure 8. Output-to-Output Skew tSK(O)
Figure 9. Propagation Delay (tPD) Test Reference
Figure 10. Propagation Delay (tPD) Test Reference
Figure 11. Propagation Delay tSK(P) Test Reference
Figure 12. Output Transition Time Test Reference
Figure 13. Cycle-to-Cycle Jitter
Figure 14
The pin-to-pin skew is defined as the worst case difference in propagation delay be-
tween any similar delay path within a single device
VCC
VCC÷2
GND
VCC
VCC÷2
GND
tSK(O)
VCC
VCC÷2
GND
t(LH)
QX
CCLK
VCC
VPP
t(HL)
VCC÷2
GND
VCC
VCC÷2
GND
t(LH)
QX
PCLK
VPP
t(HL)
VCMR
PCLK
VCC
VCC÷2
GND
t(LH)
QX
CCLK
VCC
t(HL)
VCC÷2
GND
t(HL)
tSK(P)= tPLH–tPLH
tF
tR
VCC=3.3 V VCC=2.5 V
2.4
1.8 V
0.55
0.6 V
The variation in cycle time of a signal between adjacent cycles, over a ran-
dom sample of adjacent cycle pairs
TN
TJIT(CC) = |TN -TN+1|
TN+1
相关PDF资料 |
PDF描述 |
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参数描述 |
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