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参数资料
| 型号： | MPC961CFA |
| 厂商： | INTEGRATED DEVICE TECHNOLOGY INC |
| 元件分类： | 时钟及定时 |
| 英文描述： | 961 SERIES, PLL BASED CLOCK DRIVER, 17 TRUE OUTPUT(S), 0 INVERTED OUTPUT(S), PQFP32 |
| 封装： | LQFP-32 |
| 文件页数： | 4/11页 |
| 文件大小： | 736K |
| 代理商： | MPC961CFA |
MPC961C Data Sheet
LOW VOLTAGE ZERO DELAY BUFFER
MPC961C REVISION 5 AUGUST 17, 2009
2
2009 Integrated Device Technology, Inc.
Figure 2. 32-Lead Pinout (Top View)
Table 1. Pin Configurations
Number
Name
Type
Description
CCLK
Input
LVCMOS
PLL reference clock signal
FB_IN
Input
LVCMOS
PLL feedback signal input, connect to a QFB output
F_RANGE
Input
LVCMOS
PLL frequency range select
OE
Input
LVCMOS
Output enable/disable
Q0 – Q16
Output
LVCMOS
Clock outputs
QFB
Output
LVCMOS
PLL feedback signal output, connect to a FB_IN
GND
Supply
Ground
Negative power supply
VCCA
Supply
VCC
PLL positive power supply (analog power supply). The MPC961C requires an
external RC filter for the analog power supply pin VCCA. Refer to APPLICATIONS
INFORMATION for details.
VCC
Supply
VCC
Positive power supply for I/O and core
NC
Not connected
Table 2. Function Table
Control
Default
0
1
F_RANGE
0
PLL high frequency range. MPC961C input reference and
output clock frequency range is 100 – 200 MHz
PLL low frequency range. MPC961C input reference and
output clock frequency range is 50 – 100 MHz
OE
0
Outputs enabled
Outputs disabled (high-impedance state)
Q5
Q4
Q3
GND
Q2
Q1
Q0
VCC
Q12
Q13
Q14
GND
Q15
V
CC
Q6
Q7
Q8
GND
Q9
Q10
Q11
GND
CCLK
MC
F_RANGE
V
CCA
OE
FB
_IN
V
CC
25
26
27
28
29
30
31
32
15
14
13
12
11
10
9
12
3
45
6
78
24
23
22
21
20
19
18
17
16
MPC961C
VCC
Q16
QFB
相关PDF资料 |
PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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