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参数资料
| 型号： | MSC8126VT8000 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 0-BIT, 500 MHz, OTHER DSP, PBGA431 |
| 封装： | 20 X 20 MM, LEAD FREE, PLASTIC, FCBGA-431 |
| 文件页数： | 24/48页 |
| 文件大小： | 1138K |
| 代理商： | MSC8126VT8000 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页当前第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页
MSC8126 Quad Digital Signal Processor Data Sheet, Rev. 15
Electrical Characteristics
Freescale Semiconductor
30
Figure 15 shows DSI asynchronous write signals timing.
Figure 16 shows DSI asynchronous broadcast write signals timing.
Figure 15. Asynchronous Single- and Dual-Strobe Modes Write Timing Diagram
Figure 16. Asynchronous Broadcast Write Timing Diagram
HD[0–63]
100
101
102
201
202
109
106
HWBSn2
108
110
111
112
HDBSn1
HTA4
HTA3
Notes:
1.
Used for single-strobe mode access.
2.
Used for dual-strobe mode access.
3.
HTA released at logic 0 (DCR[HTAAD] = 0) at end of access; used with pull-down implementation.
4.
HTA released at logic 1 (DCR[HTAAD] = 1) at end of access; used with pull-up implementation.
HA[11–29]
HCS
HCID[0–4]
HDST
HRW1
HRDS2
HD[0–63]
100
101
102
201
202
HWBSn2
112
HDBSn1
Notes:
1.
Used for single-strobe mode access.
2.
Used for dual-strobe mode access.
HA[11–29]
HCS
HCID[0–4]
HDST
HRW1
HRDS2
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参数描述 |
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