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参数资料
| 型号： | MSM63188A-XXX |
| 厂商： | LAPIS SEMICONDUCTOR CO LTD |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 4-BIT, MROM, 2 MHz, MICROCONTROLLER, UUC159 |
| 封装： | 6.60 X 6.60 MM, 0.35 MM HEIGHT, DIE-159 |
| 文件页数： | 18/344页 |
| 文件大小： | 1980K |
| 代理商： | MSM63188A-XXX |
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MSM63182A/184A/188A User’s Manual
Chapter 9
Timers (TIMER)
9 – 8
M188A
Figure 9-8 is an example using the timer 0 capture mode for pulse width measurement, with the following
operation.
x
Set PB.0/TM0CAP to input mode, and enable XI0INT and TM0INT.
y
Clear the timer data and timer counter registers.
z
Set TM0CON0 capture mode and set TM0RUN to “1” to begin counting up.
{
When the PB.0/TM0CAP input changes, the value of TM0CH/TM0CL is captured to TM0DH/
TM0DL, and TM0CAP is set to “1” (first capture). The CPU detects this through XI0INT, and reads
the values of TM0DH/TM0DL.
|
When TM0DH/TM0DL read is complete, TM0CAP is reset to “0” for the next capture.
}
When PB.0/TM0CAP input changes, steps { and | are repeated (second capture). The H pulse width
t1 for the PB.0 input can be determined as:
t1 = (F0H – 50H)
× tCLK
where tCLK is the TMCLK cycle.
~
When the timer counter register overflows TM0INT is generated, and this is stored. The timer counter
register changes from FFH to 00H and continues counting.
When PB.0/TM0CAP input changes, steps { and | are repeated (third capture). Because the counter
has overflowed once between the second and third captures, the L pulse width t2 for the PB.0 input
can be determined as:
t2 = (60H – F0H + 100H)
× tCLK
When TM0CAP is set to “1”, no capture occurs even when PB.0/TM0CAP changes.
Figure 9-9 shows the capture timing, and Figure 9-10 shows the capture signal (CAPT) generator circuit.
m
m + 1 m + 2
m + 3
m + 4
m + 5
m + 6
m + 1
Timer clock
PB.0/TM0CAP input
TM0CH, TM0CL
TM0DH, TM0DL
Capture signal
(CAPT)
TM0CAP
TM0STAT READ
Figure 9-9
Capture Timing
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