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参数资料
| 型号： | NCP1397BDR2G |
| 厂商： | ON Semiconductor |
| 文件页数： | 7/27页 |
| 文件大小： | 0K |
| 描述： | IC REG CTRLR ISO PWM 16-SOIC |
| 标准包装： | 2,500 |
| PWM 型： | 控制器 |
| 输出数： | 1 |
| 频率 - 最大： | 560kHz |
| 占空比： | 52% |
| 电源电压： | 10.3 V ~ 20 V |
| 降压： | 无 |
| 升压： | 无 |
| 回扫： | 无 |
| 反相： | 无 |
| 倍增器： | 无 |
| 除法器： | 无 |
| Cuk： | 无 |
| 隔离： | 是 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 16-SOIC（0.154"，3.90mm 宽）15 引线 |
| 包装： | 带卷 (TR) |
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NCP1397A, NCP1397B
ELECTRICAL CHARACTERISTICS (For typical values T J = 25 ° C, for min/max values T J = ? 40 ° C to +125 ° C, Max T J = 150 ° C,
V CC = 12 V unless otherwise noted)
Symbol
Rating
Pin
Min
Typ
Max
Unit
TIMERS
I timer2
T timer
T timerR
V timer(on)
V timer(off)
R SS(dis)
Timer capacitor charge current when V pin9 > V ref(OCP) (I charge1 +
I charge2 ) – A version only
Timer duration with a 1 m F capacitor and a 1 M W resistor, I timer1
current applied
Timer recurrence in permanent fault, same values as above
Voltage at which pin 3 stops output pulses
Voltage at which pin 3 restarts output pulses
Soft ? start discharge switch channel resistance
3
3
3
3
3
1
1.1
?
?
3.8
0.95
?
1.3
24
1.4
4
1
100
1.5
?
?
4.2
1.05
?
mA
ms
s
V
V
W
PROTECTION
V ref(Skip)
Hyste (Skip)
V ref(Fault)
Hyste (Fault)
V ref(OCP)
Hyste (OCP)
T p(Disable)
IBO (bias)
VBO
IBO
Vl atch
T SD
T SD(hyste)
Reference voltage for Skip/Disable input (Note 4)
Hysteresis for Skip/Disable (Note 4)
Reference voltage for Fault comparator
Hysteresis for fault comparator input
Reference voltage for OCP comparator
Hysteresis for OCP comparator input
Propagation delay from disable input to the drive shutdown
Brown ? Out input bias current
Brown ? Out level
Hysteresis current, V pin5 > VBO
Latching voltage
Temperature shutdown
Hysteresis
8
8
9
9
9
9
8
5
5
5
5
?
?
630
?
0.99
?
1.47
?
?
?
0.99
25
3.7
140
?
660
45
1.04
60
1.55
90
60
0.02
1.04
28
4
?
30
690
?
1.09
?
1.63
?
100
?
1.09
31
4.3
?
?
mV
mV
V
mV
V
mV
ns
m A
V
m A
V
° C
° C
3. The IC does not activate soft ? start (unless the feedback pin voltage is below 0.3 V) when the skip/disable input is released, this is for skip
cycle implementation.
4. Guaranteed by design.
http://onsemi.com
7
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PDF描述 |
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参数描述 |
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