参数资料
| 型号： | P1P8160AG-10CR |
| 厂商： | ON Semiconductor |
| 文件页数： | 2/6页 |
| 文件大小： | 0K |
| 描述： | IC CLK GEN EMI MODULATOR 8-SOIC |
| 标准包装： | 2,500 |
| 类型： | * |
| PLL： | 带旁路 |
| 输入： | LVCMOS，晶体 |
| 输出： | LVCMOS |
| 电路数： | 1 |
| 比率 - 输入:输出： | 1:2 |
| 差分 - 输入:输出： | 无/无 |
| 频率 - 最大： | 27MHz |
| 除法器/乘法器： | 无/无 |
| 电源电压： | 2.97 V ~ 3.63 V |
| 工作温度： | -10°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 10-WFDFN 裸露焊盘 |
| 供应商设备封装： | 10-WDFN（3x3） |
| 包装： | 带卷 (TR) |
P1P8160A
http://onsemi.com
2
VDD2
VSS
CLKIN/XIN
RefOUT
PLL
SS1%
XOUT
SS2%
ModOUT
2
Crystal
Oscillator
Figure 1. Block Diagram
VDD1
Table 1. PIN DESCRIPTION
Pin#
Pin Name
Type
Description
1
CLKIN / XIN
I
Crystal connection or External Reference Clock Input.
2
VSS
P
Ground to entire chip
3
SS2%
I
Frequency Deviation Selection. Trilevel logic pin. Has an internal pull down resistor.
Refer to Frequency Deviation Selection table
4
VDD1
Supply Voltage for 100 MHz ModOUT
5
ModOUT
O
Buffered 100MHz spread spectrum clock output
6
VSS
P
Ground to entire chip
7
SS1%
I
Frequency Deviation Selection. Trilevel logic pin. Has an internal pull down resistor.
Refer to Frequency Deviation Selection table
8
VDD2
P
Supply Voltage for 27 MHz RefOUT
9
RefOUT
O
Buffered reference clock output
10
XOUT
O
Crystal connection. If using an external reference, this pin must be left unconnected.
3 Level Digital Logic
SS1% and SS2% digital inputs are designed to sense 3
different logic levels designated as High “1”, Low “0” and
Middle “M”. With this 3Level digital inputs, 9 different
logic states can be detected.
Use 5k/5k resistor divider at SS1% and SS2% pins from
VDD to VSS to obtain VDD/2, Middle “M” logic level as
shown:
Logic
Control Pins
1
SS1%, SS2% to VDD
VSS
VDD
VSS
VDD
5k
M
SS1%, SS2%
0
SS1%, SS2% to VSS
(UNCONNECTED)
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PDF描述 |
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参数描述 |
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