参数资料
| 型号： | P89V660FA,512 |
| 厂商： | NXP Semiconductors |
| 文件页数： | 76/90页 |
| 文件大小： | 0K |
| 描述： | IC 80C51 MCU FLASH 16K 44-PLCC |
| 产品培训模块： | Migrating from 8/16-Bit MCUs to 32-Bit ARMs |
| 标准包装： | 1,300 |
| 系列： | 89V |
| 核心处理器： | 8051 |
| 芯体尺寸： | 8-位 |
| 速度： | 40MHz |
| 连通性： | I²C，SPI，UART/USART |
| 外围设备： | POR，PWM，WDT |
| 输入/输出数： | 36 |
| 程序存储器容量： | 16KB（16K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 512 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 4.5 V ~ 5.5 V |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 44-LCC（J 形引线） |
| 包装： | 管件 |
| 产品目录页面： | 706 (CN2011-ZH PDF) |
| 配用： | 622-1001-ND - USB IN-CIRCUIT PROG 80C51ISP |
| 其它名称： | 568-2432-5 935280828512 P89V660FA |
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P89V660_662_664
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NXP B.V. 2011. All rights reserved.
Product data sheet
Rev. 3.1 — 17 October 2011
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NXP Semiconductors
P89V660/662/664
80C51 with 512 B/1 kB/2 kB RAM, dual I2C-bus, SPI
[1]
At 100 kb/s. All other bit rates, this value is inversely proportional to the bit rate of 100 kb/s.
[2]
Determined by the external bus capacitance and pull-up resistor. This must be < 1
s.
[3]
Spikes on SDA and SCL with a duration less than 3Tcy(clk) will be filtered out. Max capacitance on SDA and SCL = 400 pF.
Fig 40. Shift register mode timing waveforms
002aaa552
ALE
0
instruction
1
2
3
4
5
6
7
8
0
1
23
45
6
7
valid
TXLXL
set TI
set RI
tXHQX
tQVXH
tXHDV
tXHDX
clock
output data
write to SBUF
input data
clear RI
Table 74.
I2C-bus interface timing (12-clock mode)
Symbol
Parameter
Conditions
Input
Output
Unit
tHD;STA
hold time (repeated) START condition
14T
cy(clk)
> 4.0[1]
s
tLOW
LOW period of the SCL clock
16T
cy(clk)
> 4.7[1]
s
tHIGH
HIGH period of the USCL clock
14T
cy(clk)
> 4.0[1]
s
tr(SCL)
SCL rise time
s
tf(SCL)
SCL fall time
0.3
0.3[3]
s
tSU;DAT
data set-up time
250
20Tcy(clk) tr(SDA)
ns
tsuDAT1
data set-up time 1
before repeated
START
250
> 1000[1]
ns
tsuDAT2
data set-up time 2
before STOP
condition
250
> 8Tcy(clk)
ns
tHD;DAT
data hold time
0> 8T
cy(clk) tf(SCL)
ns
tSU;STA
set-up time for a repeated START
condition
14T
cy(clk)
> 4.7[1]
s
tSU;STO
set-up time for STOP condition
14T
cy(clk)
> 4.0[1]
s
tBUF
bus free time between a STOP and
START condition
14T
cy(clk)
> 4.7[1]
s
tr(SDA)
SDA rise time
0.3
s
tf(SDA)
SDA fall time
0.3
0.3[3]
s
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