参数资料
型号: PEB20532
厂商: INFINEON TECHNOLOGIES AG
英文描述: 2 Channel Serial Optimized Communication Controller
中文描述: 2通道串行通信控制器的优化
文件页数: 144/282页
文件大小: 3623K
代理商: PEB20532
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PEB 20532
PEF 20532
Register Description (STARH)
Data Sheet
5-144
2000-09-14
SYNC
Synchronization Status
This bit indicates whether the receiver is in synchronized state. After a
HUNT
command
SYNC
bit is cleared and the receiver starts searching
for a SYNC character. When found the
SYNC
status bit is set
immediately, an SCD-interrupt is generated (if enabled) and receive data
is forwarded to the receiver FIFO.
SYNC=
0
Synchronization is lost or not yet achieved.
(after reset or after new
HUNT
command has been
issued and before SYNC character is found)
SYNC=
1
The receiver is in synchronized state.
(bisync mode)
RLI
Receive Line Inactive
This bit indicates that neither flags as interframe time fill nor data are
being received via the receive line.
RLI=
0
Receive line is active, no constant high level is detected.
RLI=
1
Receive line is inactive, i.e. more than 7 consecutive
1
are detected on the line.
Note: A receive clock must be provided in order to detect the receive line
state.
(hdlc mode)
DPLA
DPLL Asynchronous
This bit is only valid if the receive clock is recovered by the DPLL and
FM0, FM1 or Manchester data encoding is selected. It is set when the
DPLL has lost synchronization. In this case reception is disabled
(receive abort condition) until synchronization has been regained. In
addition transmission is interrupted in all cases where transmit clock is
derived from the DPLL (clock mode 3a, 7a). Interruption of transmission
is performed the same way as on deactivation of the CTS signal.
DPLA=
0
DPLL is synchronized.
DPLA=
1
DPLL is asynchronous (re-synchronization process is
started automatically).
(all modes)
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