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参数资料
| 型号： | PI6LC4831AZBIEX |
| 厂商： | PERICOM SEMICONDUCTOR CORP |
| 元件分类： | PLL合成/DDS/VCOs |
| 英文描述： | PLL FREQUENCY SYNTHESIZER, QCC56 |
| 封装： | 8 X 8 MM, GREEN, MO-137AE, TQFN-56 |
| 文件页数： | 14/14页 |
| 文件大小： | 891K |
| 代理商： | PI6LC4831AZBIEX |
9
www.pericom.com
P-0.1
03/28/11
Alltrademarksarepropertyoftheirrespectiveowners.
PI6LC4831A
Crystal to Differential HCSL/LVCMOS Frequency Synthesizer
AC Characteristics (VDD=VDDO_REF=VDDO_24MHz=3.3V±5%, TA=–40°C to 80°C)
Symbol
Parameter
Test Conditions
Min
Typ
Max
Units
f
OUT
Output
Frequency
Q0_Ref: nQ11_Ref
25
MHz
Q0_PLL2±
100
Q3B_PLL1, nQ2B_PLL1
24
Q(0,1)A_PLL1±
100
t
jit(per)
Period Jitter,
Peak-to-Peak
Q0_PLL2±
BER = 10E-12, 100MHz
70
ps
Q3B_PLL1, nQ2B_PLL1
BER = 10E-12, 24MHz
95
Q(0,1)A_PLL1±
BER = 10E-12, 100MHz
70
t
jit(cc)
Cycle-to-Cycle
Jitter; (1,2)
Q0_Ref: nQ11_Ref
25MHz
30
Q0_PLL2±
100MHz
80
Q3B_PLL1, nQ2B_PLL1
24MHz
90
Q(0,1)A_PLL1±
100MHz
70
t
RESET
Minimum Reset Time for RESET
1.6
ns
t
OEPD
Maximum Propagation Delay from OE
Register to Clock
100
t
L
PLL Lock Time
50
ms
F
xtal
Crystal Input Range(1)
25
MHz
F
M
SSC Modulation Frequency(3)
29
33.33
kHz
F
MF
SSC Modulation Factor(3)
–
0.4
–
0.5
%
SSC
red
Spectral Reduction (3)
4
6
dB
t
STABLE
Power-up to Stable Clock Output (4,5)
500
ps
V
MAX
Absolute Maximum Output Volltage; (6,7)
HCSL Levels
1150
mV
V
MIN
Absolute Minimum Output Volltage; (6,8)
HCSL Levels
–
300
V
rb
Ringback Voltage; (4,5)
HCSL Levels
–
100
V
CROSS
Absolute Crossing Voltage; (6,9,10)
HCSL Levels
250
550
D
V
CROSS
Total Variation of VCROSS;(6,9,11)
HCSL Levels
140
t
R / tF
Output Rise/
Fall Time
Q0_Ref : nQ11_Ref, Q3B_
PLL1, nQ2B_PLL1
20% to 80%
150
350
ps
Rise/Fall Edge
Rate
Q(0,1)A_PLL1±, Q0_
PLL2± (4)
0.6
5
V/ns
odc
Output Duty
Cycle;
Q0_Ref: nQ11_Ref
42
58
%
Q3B_PLL1, nQ2B_PLL1
49
51
Q(0,1)A_PLL1±, Q0_
PLL2± (4)
49
51
(see notes on following page)
11-0032
相关PDF资料 |
PDF描述 |
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