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参数资料
| 型号： | PIC12F683T-E/SN |
| 厂商： | Microchip Technology |
| 文件页数： | 130/176页 |
| 文件大小： | 0K |
| 描述： | IC MCU FLASH 2KX14 8SOIC |
| 产品培训模块： | Asynchronous Stimulus |
| Digi-Key 应用说明： | AN0005 PWM Example with Microchip's CCP Module AN0005 Example Code |
| 标准包装： | 3,300 |
| 系列： | PIC® 12F |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 20MHz |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 5 |
| 程序存储器容量： | 3.5KB（2K x 14） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 256 x 8 |
| RAM 容量： | 128 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2 V ~ 5.5 V |
| 数据转换器： | A/D 4x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 8-SOIC（0.154"，3.90mm 宽） |
| 包装： | 带卷 (TR) |
| 配用： | AC162058-ND - HEADER MPLAB ICD2 FOR PIC12F683 I3-DB12F683-ND - BOARD DAUGHTER ICEPIC3 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页第123页第124页第125页第126页第127页第128页第129页当前第130页第131页第132页第133页第134页第135页第136页第137页第138页第139页第140页第141页第142页第143页第144页第145页第146页第147页第148页第149页第150页第151页第152页第153页第154页第155页第156页第157页第158页第159页第160页第161页第162页第163页第164页第165页第166页第167页第168页第169页第170页第171页第172页第173页第174页第175页第176页
2007 Microchip Technology Inc.
DS41211D-page 55
PIC12F683
8.6
Comparator Interrupt Operation
The comparator interrupt flag is set whenever there is
a change in the output value of the comparator.
Changes are recognized by means of a mismatch cir-
cuit which consists of two latches and an exclusive-or
gate (see Figure 8.2). One latch is updated with the
comparator output level when the CMCON0 register is
read. This latch retains the value until the next read of
the CMCON0 register or the occurrence of a Reset.
The other latch of the mismatch circuit is updated on
every Q1 system clock. A mismatch condition will occur
when a comparator output change is clocked through
the second latch on the Q1 clock cycle. The mismatch
condition will persist, holding the CMIF bit of the PIR1
register true, until either the CMCON0 register is read
or the comparator output returns to the previous state.
Software will need to maintain information about the
status of the comparator output to determine the actual
change that has occurred.
The CMIF bit of the PIR1 register, is the comparator
interrupt flag. This bit must be reset in software by
clearing it to ‘0’. Since it is also possible to write a ‘1’ to
this register, a simulated interrupt may be initiated.
The CMIE bit of the PIE1 register and the PEIE and GIE
bits of the INTCON register must all be set to enable
comparator interrupts. If any of these bits are cleared,
the interrupt is not enabled, although the CMIF bit of
the PIR1 register will still be set if an interrupt condition
occurs.
The user, in the Interrupt Service Routine, can clear the
interrupt in the following manner:
a)
Any read or write of CMCON0. This will end the
mismatch condition.
b)
Clear the CMIF interrupt flag.
A persistent mismatch condition will preclude clearing
the CMIF interrupt flag. Reading CMCON0 will end the
mismatch condition and allow the CMIF bit to be
cleared.
FIGURE 8-5:
COMPARATOR
INTERRUPT TIMING W/O
CMCON0 READ
FIGURE 8-6:
COMPARATOR
INTERRUPT TIMING WITH
CMCON0 READ
Note:
A write operation to the CMCON0 register
will also clear the mismatch condition
because
all
writes
include
a
read
operation at the beginning of the write
cycle.
Note:
If a change in the CMCON0 register
(COUT)
should
occur
when
a
read
operation is being executed (start of the
Q2 cycle), then the CMIF interrupt flag
may not get set.
Note 1: If a change in the CMCON0 register
(COUT) should occur when a read opera-
tion is being executed (start of the Q2
cycle), then the CMIF of the PIR1 register
interrupt flag may not get set.
2: When either comparator is first enabled,
bias circuitry in the Comparator module
may cause an invalid output from the
comparator until the bias circuitry is
stable. Allow about 1
μs for bias settling
then clear the mismatch condition and
interrupt flags before enabling comparator
interrupts.
Q1
Q3
CIN+
COUT
Set CMIF (level)
CMIF
TRT
reset by software
Q1
Q3
CIN+
COUT
Set CMIF (level)
CMIF
TRT
reset by software
cleared by CMCON0 read
相关PDF资料 |
PDF描述 |
|---|---|
| PIC16F630T-E/SL | IC MCU FLASH 1KX14 14SOIC |
| PIC16LF1903-E/MV | MCU 7KB FLASH 256B RAM 28UQFN |
| D38999/26JJ7PN | CONN PLUG 99POS STRAIGHT W/PINS |
| PIC16LF722T-I/SO | IC PIC MCU FLASH 3.5KB 28-SOIC |
| D38999/26MJ7PN | CONN PLUG 99POS STRAIGHT W/PINS |
相关代理商/技术参数 |
参数描述 |
|---|---|
| PIC12F683T-I/MD | 功能描述:8位微控制器 -MCU 3.5KB 128 RAM 6I/O RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| PIC12F683T-I/MDQTP | 制造商:MICROCHIP 制造商全称:Microchip Technology 功能描述:8-Pin Flash-Based, 8-Bit CMOS Microcontrollers with nanoWatt Technology |
| PIC12F683T-I/MF | 功能描述:8位微控制器 -MCU 3.5KB 128 RAM 6 I/O RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| PIC12F683T-I/MFQTP | 制造商:MICROCHIP 制造商全称:Microchip Technology 功能描述:8-Pin Flash-Based, 8-Bit CMOS Microcontrollers with nanoWatt Technology |
| PIC12F683T-I/P | 制造商:MICROCHIP 制造商全称:Microchip Technology 功能描述:8-Pin Flash-Based, 8-Bit CMOS Microcontrollers with nanoWatt Technology |
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