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参数资料
| 型号： | PIC16LF1947T-I/MR |
| 厂商： | Microchip Technology |
| 文件页数： | 33/46页 |
| 文件大小： | 0K |
| 描述： | MCU 8BIT 28KB FLASH 64QFN |
| 标准包装： | 3,300 |
| 系列： | PIC® XLP™ 16F |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 32MHz |
| 连通性： | I²C，LIN，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，LCD，POR，PWM，WDT |
| 输入/输出数： | 54 |
| 程序存储器容量： | 28KB（16K x 14） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 256 x 8 |
| RAM 容量： | 1K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 1.8 V ~ 3.6 V |
| 数据转换器： | A/D 17x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 64-VFQFN 裸露焊盘 |
| 包装： | 带卷 (TR) |
| 配用： | MA160016-ND - MODULE PLUG-IN PIC16F1947 MA160015-ND - MODULE PLUG-IN PIC16LF1947 DM240313-ND - BOARD DEMO 8BIT XLP |
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2010 Microchip Technology Inc.
DS41397B-page 39
PIC16F193X/LF193X/PIC16F194X/LF194X/
8.0
ELECTRICAL SPECIFICATIONS
Refer to device specific data sheet for absolute
maximum ratings.
TABLE 8-1:
AC/DC CHARACTERISTICS TIMING REQUIREMENTS FOR PROGRAM/VERIFY MODE
AC/DC CHARACTERISTICS
Standard Operating Conditions
Production tested at 25°C
Sym.
Characteristics
Min.
Typ.
Max.
Units
Conditions/Comments
Supply Voltages and currents
VDD
VDD
Read/Write and Row Erase
operations
PIC16F193X/
PIC16F194X
2.1
—
5.5
V
PIC16LF193X/
PIC16LF194X
2.1
—
3.6
V
PIC16LF190X
1.8
—
3.6
V
Bulk Erase operations
PIC16F193X/
PIC16F194X
2.7
—
5.5
V
PIC16LF193X/
PIC16LF194X
2.7
—
3.6
V
PIC16LF190X
2.6
—
3.6
V
IDDI
Current on VDD, Idle
—
1.0
mA
IDDP
Current on VDD, Programming
—
3.0
mA
IPP
VPP
Current on MCLR/VPP
—
600
A
VIHH
High voltage on MCLR/VPP for
Program/Verify mode entry
8.0
—
9.0
V
TVHHR
MCLR rise time (VIL to VIHH) for
Program/Verify mode entry
——
1.0
s
I/O pins
VIH
(ICSPCLK, ICSPDAT, MCLR/VPP) input high level
0.8 VDD
——
V
VIL
(ICSPCLK, ICSPDAT, MCLR/VPP) input low level
—
0.2 VDD
V
VOH
ICSPDAT output high level
VDD-0.7
——
V
IOH = 3.5 mA, VDD = 5V
IOH = 3 mA, VDD = 3.3V
IOH = 2 mA, VDD = 1.8V
VOL
ICSPDAT output low level
——
VSS+0.6
V
IOH = 8 mA, VDD = 5V
IOH = 6 mA, VDD = 3.3V
IOH = 3 mA, VDD = 1.8V
Programming mode entry and exit
TENTS
Programing mode entry setup time: ICSPCLK,
ICSPDAT setup time before VDD or MCLR
100
—
ns
TENTH
Programing mode entry hold time: ICSPCLK,
ICSPDAT hold time after VDD or MCLR
250
—
s
Serial Program/Verify
TCKL
Clock Low Pulse Width
100
—
ns
TCKH
Clock High Pulse Width
100
—
ns
TDS
Data in setup time before clock
100
—
ns
TDH
Data in hold time after clock
100
—
ns
TCO
Clock
to data out valid (during a
Read Data command)
0
—
80
ns
TLZD
Clock
to data low-impedance (during a
Read Data command)
0
—
80
ns
THZD
Clock
to data high-impedance (during a
Read Data command)
0
—
80
ns
TDLY
Data input not driven to next clock input (delay
required between command/data or command/
command)
1.0
—
s
TERAB
Bulk Erase cycle time
—
5
ms
TERAR
Row Erase cycle time
—
2.5
ms
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PDF描述 |
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