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参数资料
| 型号： | PIC16LF627-04/P |
| 厂商： | Microchip Technology |
| 文件页数： | 144/170页 |
| 文件大小： | 0K |
| 描述： | IC MCU FLASH 1KX14 COMP 18DIP |
| 产品培训模块： | Asynchronous Stimulus 8-bit PIC® Microcontroller Portfolio |
| 标准包装： | 25 |
| 系列： | PIC® 16F |
| 核心处理器： | PIC |
| 芯体尺寸： | 8-位 |
| 速度： | 4MHz |
| 连通性： | UART/USART |
| 外围设备： | 欠压检测/复位，POR，PWM，WDT |
| 输入/输出数： | 16 |
| 程序存储器容量： | 1.75KB（1K x 14） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 128 x 8 |
| RAM 容量： | 224 x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2 V ~ 5.5 V |
| 振荡器型： | 内部 |
| 工作温度： | 0°C ~ 70°C |
| 封装/外壳： | 18-DIP（0.300"，7.62mm） |
| 包装： | 管件 |
| 其它名称： | PIC16LF627-04/PR PIC16LF627-04/PR-ND |
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2003 Microchip Technology Inc.
Preliminary
DS40300C-page 73
PIC16F62X
The data on the RB1/RX/DT pin is sampled three times
by a majority detect circuit to determine if a high or a
low level is present at the RX pin. If bit BRGH
(TXSTA<2>) is clear (i.e., at the low baud rates), the
sampling is done on the seventh, eighth and ninth
falling edges of a x16 clock (Figure 12-3). If bit BRGH
is set (i.e., at the high baud rates), the sampling is done
on the 3 clock edges preceding the second rising edge
after the first falling edge of a x4 clock (Figure 12-4 and
FIGURE 12-1:
RX PIN SAMPLING SCHEME. BRGH = 0
FIGURE 12-2:
RX PIN SAMPLING SCHEME, BRGH = 1
FIGURE 12-3:
RX PIN SAMPLING SCHEME, BRGH = 1
RX
baud CLK
x16 CLK
START bit
Bit0
Samples
1
2
3
4
5
6
7
8
9
10
11
12
13
14
15
16
1
2
3
Baud CLK for all but START bit
(RB1/RX/DT pin)
RX pin
baud clk
x4 clk
Q2, Q4 clk
START Bit
Bit0
Bit1
First falling edge after RX pin goes low
Second rising edge
Samples
1
2
3
4
1
2341
2
RX pin
Baud CLK
x4 CLK
Q2, Q4 CLK
START Bit
Bit0
First falling edge after RX pin goes low
Second rising edge
Samples
12
3
4
Baud CLK for all but START bit
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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