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参数资料
型号： PIC18F44K20-E/PT
厂商： Microchip Technology
文件页数： 21/42页
文件大小： 0K
描述： IC PIC MCU FLASH 8KX16 44-TQFP
产品培训模块： XLP Deep Sleep Mode
8-bit PIC® Microcontroller Portfolio
标准包装： 160
系列： PIC® XLP™ 18F
核心处理器： PIC
芯体尺寸： 8-位
速度： 48MHz
连通性： I²C，SPI，UART/USART
外围设备： 欠压检测/复位，HLVD，POR，PWM，WDT
输入/输出数： 35
程序存储器容量： 16KB（8K x 16）
程序存储器类型： 闪存
EEPROM 大小： 256 x 8
RAM 容量： 768 x 8
电压 - 电源 (Vcc/Vdd)： 1.8 V ~ 3.6 V
数据转换器： A/D 14x10b
振荡器型： 内部
工作温度： -40°C ~ 125°C
封装/外壳： 44-TQFP
包装： 管件
产品目录页面： 643 (CN2011-ZH PDF)
配用： AC164112-ND - VOLTAGE LIMITER MPLAB ICD2 VPP
DM164124-ND - KIT STARTER FOR PIC18F4XK20
AC164305-ND - MODULE SKT FOR PM3 44TQFP
PIC18F2XK20/4XK20
DS41297F-page 28
Advance Information
2009 Microchip Technology Inc.
5.0
CONFIGURATION WORD
The
PIC18F2XK20/4XK20
devices
have
several
Configuration Words. These bits can be set or cleared
to select various device configurations. All other mem-
ory areas should be programmed and verified prior to
setting Configuration Words. These bits may be read
out normally, even after read or code protection. See
Table 5-1 for a list of Configuration bits and device IDs
and Table 5-3 for the Configuration bit descriptions.
5.1
User ID Locations
A user may store identification information (ID) in eight
ID locations mapped in 200000h:200007h. It is recom-
mended that the Most Significant nibble of each ID be
Fh. In doing so, if the user code inadvertently tries to
execute from the ID space, the ID data will execute as
a NOP.
5.2
Device ID Word
The device ID word for the PIC18F2XK20/4XK20
devices is located at 3FFFFEh:3FFFFFh. These bits
may be used by the programmer to identify what device
type is being programmed and read out normally, even
after code or read protection. See Table 5-2 for a
complete list of device ID values.
FIGURE 5-1:
READ DEVICE ID WORD
FLOW
TABLE 5-1:
CONFIGURATION BITS AND DEVICE IDs
Start
Set TBLPTR = 3FFFFE
Done
Read Low Byte
Read High Byte
with Post-Increment
File Name
Bit 7
Bit 6
Bit 5
Bit 4
Bit 3
Bit 2
Bit 1
Bit 0
Default/
Unprogrammed
Value
300001h
CONFIG1H
IESO
FCMEN
—
FOSC3
FOSC2
FOSC1
FOSC0
00-- 0111
300002h
CONFIG2L
—
BORV1
BORV0
BOREN1 BOREN0 PWRTEN
---1 1111
300003h
CONFIG2H
—
WDTPS3 WDTPS2 WDTPS1 WDTPS0
WDTEN
---1 1111
300005h
CONFIG3H
MCLRE
—
HFOFST LPT1OSC PBADEN CCP2MX
1--- 1011
300006h
CONFIG4L
DEBUG
XINST
—
—LVP
—STVREN
10-- -1-1
300008h
CONFIG5L
—
—CP3(1)
CP2(1)
CP1
CP0
---- 1111
300009h
CONFIG5H
CPD
CPB
—
11-- ----
30000Ah
CONFIG6L
—
—WRT3(1)
WRT2(1)
WRT1
WRT0
---- 1111
30000Bh
CONFIG6H
WRTD
WRTB
WRTC
—
111- ----
30000Ch
CONFIG7L
—
—EBTR3(1) EBTR2(1)
EBTR1
EBTR0
---- 1111
30000Dh
CONFIG7H
—EBTRB
—
-1-- ----
3FFFFEh
DEVID1(2)
DEV2
DEV1
DEV0
REV4
REV3
REV2
REV1
REV0
See Table 5-2
3FFFFFh
DEVID2(2)
DEV10
DEV9
DEV8
DEV7
DEV6
DEV5
DEV4
DEV3
See Table 5-2
Legend:
x
= unknown, u = unchanged, – = unimplemented. Shaded cells are unimplemented, read as ‘0’.
Note
1:
These bits are only implemented on specific devices. Refer to Section 2.3 “Memory Maps” to determine which bits
apply based on available memory.
2:
DEVID registers are read-only and cannot be programmed by the user.
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