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参数资料
| 型号： | PIC24HJ128GP310T-I/PT |
| 厂商： | Microchip Technology |
| 文件页数： | 259/292页 |
| 文件大小： | 0K |
| 描述： | IC PIC MCU FLASH 128KB 100TQFP |
| 产品培训模块： | Graphics LCD System and PIC24 Interface Asynchronous Stimulus |
| 标准包装： | 1,200 |
| 系列： | PIC® 24H |
| 核心处理器： | PIC |
| 芯体尺寸： | 16-位 |
| 速度： | 40 MIP |
| 连通性： | I²C，IrDA，LIN，SPI，UART/USART |
| 外围设备： | 欠压检测/复位，DMA，POR，PWM，WDT |
| 输入/输出数： | 85 |
| 程序存储器容量： | 128KB（43K x 24） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 16K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 3 V ~ 3.6 V |
| 数据转换器： | A/D 32x10b/12b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 100-TQFP |
| 包装： | 带卷 (TR) |
| 配用： | AC164333-ND - MODULE SKT FOR PM3 100QFP DM300024-ND - KIT DEMO DSPICDEM 1.1 MA240012-ND - MODULE PLUG-IN PIC24H 100QFP DV164033-ND - KIT START EXPLORER 16 MPLAB ICD2 DM240001-ND - BOARD DEMO PIC24/DSPIC33/PIC32 |
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2009 Microchip Technology Inc.
DS70175H-page 67
PIC24HJXXXGPX06/X08/X10
7.0
INTERRUPT CONTROLLER
The PIC24HJXXXGPX06/X08/X10 interrupt controller
reduces the numerous peripheral interrupt request
signals to a single interrupt request signal to the
PIC24HJXXXGPX06/X08/X10 CPU. It has the follow-
ing features:
Up to 8 processor exceptions and software traps
7 user-selectable priority levels
Interrupt Vector Table (IVT) with up to 118 vectors
A unique vector for each interrupt or exception
source
Fixed priority within a specified user priority level
Alternate Interrupt Vector Table (AIVT) for debug
support
Fixed interrupt entry and return latencies
7.1
Interrupt Vector Table
The Interrupt Vector Table (IVT) is shown in Figure 7-1.
The IVT resides in program memory, starting at location
000004h. The IVT contains 126 vectors consisting of
8 nonmaskable trap vectors plus up to 118 sources of
interrupt. In general, each interrupt source has its own
vector. Each interrupt vector contains a 24-bit wide
address. The value programmed into each interrupt
vector location is the starting address of the associated
Interrupt Service Routine (ISR).
Interrupt vectors are prioritized in terms of their natural
priority; this priority is linked to their position in the
vector table. All other things being equal, lower
addresses have a higher natural priority. For example,
the interrupt associated with vector 0 will take priority
over interrupts at any other vector address.
PIC24HJXXXGPX06/X08/X10 devices implement up
to 61 unique interrupts and 5 nonmaskable traps.
7.1.1
ALTERNATE VECTOR TABLE
The Alternate Interrupt Vector Table (AIVT) is located
after the IVT, as shown in Figure 7-1. Access to the
AIVT is provided by the ALTIVT control bit
(INTCON2<15>). If the ALTIVT bit is set, all interrupt
and exception processes use the alternate vectors
instead of the default vectors. The alternate vectors are
organized in the same manner as the default vectors.
The AIVT supports debugging by providing a means to
switch between an application and a support environ-
ment without requiring the interrupt vectors to be
reprogrammed. This feature also enables switching
between applications for evaluation of different soft-
ware algorithms at run time. If the AIVT is not needed,
the AIVT should be programmed with the same
addresses used in the IVT.
7.2
Reset Sequence
A device Reset is not a true exception because the
interrupt controller is not involved in the Reset process.
The PIC24HJXXXGPX06/X08/X10 device clears its
registers in response to a Reset which forces the PC to
zero. The digital signal controller then begins program
execution at location 0x000000. The user programs a
GOTO
instruction at the Reset address which redirects
program execution to the appropriate start-up routine.
Note:
This data sheet summarizes the features
of the PIC24HJXXXGPX06/X08/X10 fam-
ily of devices. However, it is not intended
to be a comprehensive reference source.
To complement the information in this data
sheet, refer to the “PIC24H Family Refer-
ence Manual”, Section 6. “Interrupts”
(DS70224), which is available from the
Note:
Any unimplemented or unused vector
locations in the IVT and AIVT should be
programmed with the address of a default
interrupt handler routine that contains a
RESET
instruction.
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