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参数资料
| 型号： | PSD413A2F |
| 英文描述： | Field Programmable Microcontroller Peripherals with Flash Memory(可编程逻辑，16K位SRAM,35个可编程I/O,通用PLD有59个输入) |
| 中文描述： | 现场可编程微控制器外围设备与快闪记忆体（可编程逻辑，16K的位的SRAM，35余个可编程输入/输出，通用PLD的有59个输入） |
| 文件页数： | 17/98页 |
| 文件大小： | 365K |
| 代理商： | PSD413A2F |
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PSD413F Family
6-17
ADVANCE INFORMATION
The ZPLD Power Management
The ZPLD implements a Zero Power Mode, which provides considerable power savings
for low to medium frequency operations. To enable this feature, the ZPLD Turbo bit in the
Power Management Mode Register 0 (PMMR0) has to be turned off.
If none of the inputs to the ZPLD are switching for a time period of 90ns, the ZPLD puts
itself into Zero Power Mode and the current consumption is minimal. The ZPLD will
resume normal operation as soon as one or more of the inputs change state.
Two other features of the ZPLD provide additional power savings:
1. Clock Disable:
Users can disable the clock input to the ZPLD and/or macrocells,thereby reducing
AC power consumption.
2. Product Term Disable:
Unused product terms in the ZPLD are disabled by the PSDsoft Software
automatically for further power savings.
The ZPLD power configuration is described in the Power Management Unit section.
The ZPLD Flash Memory Control
Five of the Macrocells in the GPLD are reserved for the generation of Flash memory
control signals. Table 4 shows the signal names and macrocells used. See the
Memory
section for a detailed description of the function of these signals.
PSD413A1F
ZPLD Block
(Cont.)
Table 4.
Signal Name
Macrocell Used
WRF
PA0
RDF
PA1
A15F
PA2
A16F
PA3
CSF
PB0
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| PSD4235G2-90UI | 功能描述:CPLD - 复杂可编程逻辑器件 5.0V 4M 90ns RoHS:否 制造商:Lattice 系列: 存储类型:EEPROM 大电池数量:128 最大工作频率:333 MHz 延迟时间:2.7 ns 可编程输入/输出端数量:64 工作电源电压:3.3 V 最大工作温度:+ 90 C 最小工作温度:0 C 封装 / 箱体:TQFP-100 |
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