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参数资料
| 型号： | PSD833F2-15M |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 1M X 1 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQFP52 |
| 封装： | PLASTIC, QFP-52 |
| 文件页数： | 106/122页 |
| 文件大小： | 489K |
| 代理商： | PSD833F2-15M |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页当前第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页第121页第122页
PSD8XXF Family
Preliminary Information
80
PSD8XXF AC/DC Parameters – CPLD Timing Parameters
(5 V ± 10% Versions)
-90
-15
PT
TURBO
Slew
Symbol
Parameter
Conditions
Min
Max
Min
Max
Aloc
OFF
Rate
Unit
Maximum Frequency
External Feedback
1/(tSA+t COA)
26.32
21.27
MHz
Maximum Frequency
fMAXA
Internal Feedback
1/(tSA+t COA–10)
35.71
27.78
MHz
(fCNTA)
Maximum Frequency
Pipelined Data
1/(tCH A+t CLA)
41.67
35.71
MHz
tSA
Input Setup Time
8
12
Add 2 Add 10
ns
tHA
Input Hold Time
12
14
ns
tCHA
Clock Input High Time
12
15
Add 10
ns
tCLA
Clock Input Low Time
12
15
Add 10
ns
tCOA
Clock to Output Delay
30
37
Add 10 Sub 2
ns
tARDA
CPLD Array Delay
Any Micro
Cell
16
22
Add 2
ns
tMINA
Minimum Clock Period
1/ fCNTA
28
43
ns
CPLD Micro
Cell Asynchronous Clock Mode Timing (5 V ± 10% Versions)
-90
-15
PT
TURBO
Symbol
Parameter
Conditions
Min
Max
Min
Max
Aloc
OFF
Unit
tIS
Input Setup Time
(Note 1)
0
ns
tIH
Input Hold Time
(Note 1)
20
26
Add 10
ns
tINH
NIB Input High Time
(Note 1)
12
18
ns
tINL
NIB Input Low Time
(Note 1)
12
18
ns
tINO
NIB Input to Combinatorial Delay
(Note 1)
46
59
Add 2 Add 10
ns
Input Micro
Cell Timing (5 V ± 10% Versions)
NOTE: 1. Inputs from Port A, B, and C relative to register/latch clock from the PLD. ALE/AS latch timings refer to tAVLX and tLXAX.
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PDF描述 |
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