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参数资料
| 型号： | PSD833F2-15M |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 1M X 1 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQFP52 |
| 封装： | PLASTIC, QFP-52 |
| 文件页数： | 121/122页 |
| 文件大小： | 489K |
| 代理商： | PSD833F2-15M |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页第104页第105页第106页第107页第108页第109页第110页第111页第112页第113页第114页第115页第116页第117页第118页第119页第120页当前第121页第122页
PSD8XXF Family
Preliminary Information
94
-15
-20
Symbol
Parameter
Conditions
Min
Max
Min
Max
Unit
tLVDV
ALE Access Time from
Power Down
150
200
ns
Maximum Delay from APD Enable
tCLWH
to Internal PDN Valid Signal
Using CLKIN Input
15 * tCLCL (Note 1)
s
Power Down Timing (3 V Versions)
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
tNLNH
Warm RESET Active Low Time (Note 1)
300
ns
tOPR
RESET High to Operational Device
300
ns
tNLNH-PO
Power On Reset Active Low Time
1
ms
Warm Reset, will abort and reset Flash
tNLNH-A
programming/erase cycles to Read
25
s
mode. For PSD8X4FV only.
Reset Pin Timing (3 V Versions)
NOTE: 1. tCLCL is the CLKIN clock period.
Microcontroller Interface – PSD8XXFV AC/DC Parameters
(3 V Versions)
Symbol
Parameter
Conditions
Min
Typ
Max
Unit
tBVBH
Vstby Detection to Vstbyon Output
High
(Note 1)
20
s
tBXBL
Vstby Off Detection to Vstbyon
Output Low
(Note 1)
20
s
Vstbyon Timing (3 V Versions)
NOTE: 1. RESET will not reset Flash programming/erase cycles.
2. RESET will abort Flash programming or erase cycle.
NOTE: 1. Vstbyon is measured at VCC ramp rate of 2 ms.
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PDF描述 |
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参数描述 |
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