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参数资料
| 型号： | PSD853F2-15JIT |
| 厂商： | STMICROELECTRONICS |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 128K X 8 FLASH, 27 I/O, PIA-GENERAL PURPOSE, PQCC52 |
| 封装： | PLASTIC, LCC-52 |
| 文件页数： | 56/103页 |
| 文件大小： | 1180K |
| 代理商： | PSD853F2-15JIT |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页当前第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页第96页第97页第98页第99页第100页第101页第102页第103页
PSD8XXF2/3/4/5
56/103
Port D – Functionality and Structure
ure 28. This port does not support Address Out
mode, and therefore no Control Register is re-
quired. Port D can be configured to perform one or
more of the following functions:
s
MCU I/O Mode
s
CPLD Output – External Chip Select (ECS0-
ECS2)
s
CPLD Input – direct input to the CPLD, no Input
Macrocells (IMC)
s
Slew rate – pins can be set up for fast slew rate
Port D pins can be configured in PSDsoft Express
as input pins for other dedicated functions:
s
Address Strobe (ALE/AS, PD0)
s
CLKIN (PD1) as input to the macrocells flip-
flops and APD counter
s
PSD Chip Select Input (CSI, PD2). Driving this
signal High disables the Flash memory, SRAM
and CSIOP.
Figure 27. Port D Structure
INTERNAL
DATA
BUS
DATA OUT
REG.
DQ
WR
ECS[ 2: 0]
READ MUX
P
D
B
CPLD - INPUT
DIR REG.
DATA IN
ENABLE PRODUCT
TERM (.OE)
OUTPUT
SELECT
OUTPUT
MUX
PORT D PIN
DATA OUT
AI02889
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