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参数资料
| 型号： | PUMA2S1000M-35 |
| 元件分类： | SRAM |
| 英文描述： | 32K X 32 MULTI DEVICE SRAM MODULE, 35 ns, CPGA66 |
| 封装： | CERAMIC, PGA-66 |
| 文件页数： | 4/9页 |
| 文件大小： | 240K |
| 代理商： | PUMA2S1000M-35 |
ISSUE 4.3 : November 1998
PUMA 2S1000 - 25/35/45
4
AC OPERATING CONDITIONS
Read Cycle
20
25
35
45
Parameter
Symbol
min max
min
max
min
max
min
max
Unit
Read Cycle Time
t
RC
20
-
25
-
35
-
45
-
ns
Address Access Time
t
AA
-
20
-
25
-
35
-
45
ns
Chip Select Access Time
t
ACS
-
20
-
25
-
35
-
45
ns
Output Enable to Output Valid
t
OE
-
9
-
12
-
15
-
20
ns
Output Hold from Address Change
t
OH
3
-
5
-
5
-
5
-
ns
Chip Selection to Output in Low Z
t
CLZ
3
-
6
-
6
-
6
-
ns
Output Enable to Output in Low Z
t
OLZ
0
-
0
-
0
-
0
-
ns
Chip Deselection to Output in High Z(3)
t
CHZ
0
8
0
12
0
15
0
20
ns
Output Disable to Output in High Z(3)
t
OHZ
0
8
0
12
0
15
0
20
ns
Under Development
Write Cycle
20
25
35
45
Parameter
Symbol
min max
min
max
min
max
min
max
Unit
Write Cycle Time
t
WC
20
-
25
-
35
-
45
-
ns
Chip Selection to End of Write
t
CW
13
-
20
-
30
-
40
-
ns
Address Valid to End of Write
t
AW
13
-
20
-
30
-
40
-
ns
Address Setup Time
t
AS
0
-
0
-
0
-
0
-
ns
Write Pulse Width
t
WP
13
-
15
-
20
-
25
-
ns
Write Recovery Time
t
WR
0
-
0
-
0
-
0
-
ns
Write to Output in High Z
t
WHZ
0
8
0
15
0
18
0
20
ns
Data to Write Time Overlap
t
DW
10
-
20
-
20
-
20
-
ns
Data Hold from Write Time
t
DH
0
-
0
-
0
-
0
-
ns
Output Active from End of Write
t
OW
0
-
5
-
5
-
5
-
ns
相关PDF资料 |
PDF描述 |
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