参数资料
型号: R5F5630BDDFB
元件分类: 微控制器/微处理器
英文描述: 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PQFP144
封装: 20 X 20 MM, 0.50 MM PITCH, PLASTIC, LQFP-144
文件页数: 121/337页
文件大小: 14635K
代理商: R5F5630BDDFB
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R01UH0040EJ0100 Rev.1.00
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Sep 8, 2011
RX630 Group
7. Option-Setting Memory
IWDTRPES[1:0] Bits (IWDT Window End Position Select)
These bits select the position of the end of the window for the down-counter as 0%, 25%, 50%, or 75% of the value being
counted by the counter. The value of the window end position must be smaller than the value of the window start position
(window start position > window end position). If the value for the window end position is greater than the value for the
window start position, only the value for the window start position is effective.
The counter values corresponding to the settings for the start and end positions of the window in the IWDTRPSS[1:0]
and IWDTRPES[1:0] bits vary with the setting of the IWDTTOPS[1:0] bits.
IWDTRPSS[1:0] Bits (IWDT Window Start Position Select)
These bits select the position where the window for the down-counter starts as 25%, 50%, 75%, or 100% of the value
being counted (the point at which counting starts is 100% and the point at which an underflow occurs is 0%). The
interval between the positions where the window starts and ends becomes the period in which refreshing is possible, and
refreshing is not possible outside this period.
IWDTRSTIRQS Bit (IWDT Reset Interrupt Request Select)
The setting of this bit selects the operation on an underflow of the down-counter or generation of a refresh error. Either
an independent watchdog timer reset or a non-maskable interrupt request is selectable.
IWDTSLCSTP Bit (IWDT Sleep Mode Count Stop Control)
This bit selects to stop counting when entering sleep, software standby, deep software standby, or all-module clock stop
mode.
WDTSTRT Bit (WDT Start Mode Select)
This bit selects the mode in which the WDT is activated after a reset (stopped state or activated in auto-start mode).
When activated in auto-start mode, the OFS0 register setting for the WDT is effective.
WDTTOPS[1:0] Bits (WDT Timeout Period Select)
These bits select the timeout period, i.e. the time it takes for the downcounter to underflow, as 1024, 4096, 8192, or
16384 cycles of the frequency-divided clock set by the WDTCKS[3:0] bits. The time (number of PCLK cycles) it takes
to underflow after a refresh operation is determined by a combination of the WDTCKS[3:0] bits and WDTTOPS[1:0]
bits.
WDTCKS[3:0] Bits (WDT Clock Frequency Division Ratio Select)
These bits select, from 1/4, 1/64, 1/128, 1/512, 1/2048, and 1/8192, the division ratio of the prescaler to divide the
frequency of PCLK. Using the setting of these bits together with the WDTTOPS[1:0] bit setting, the WDT counting
period can be set from 4096 to 134217728 PCLK cycles.
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PDF描述
R5F5630DCDFC 32-BIT, FLASH, 100 MHz, MICROCONTROLLER, PQFP176
R5F61634N50FPV 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP120
R5F61642N50FPV 32-BIT, FLASH, 50 MHz, MICROCONTROLLER, PQFP144
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参数描述
R5F5630BDDFB#V0 制造商:Renesas Electronics Corporation 功能描述:RX630 1MB, 96KB LQFP144 100MHZ - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 32BIT 1MB FLASH 144LQFP
R5F5630BDDFC 制造商:RENESAS 制造商全称:Renesas Technology Corp 功能描述:Renesas MCUs
R5F5630BDDFC#V0 制造商:Renesas Electronics Corporation 功能描述:RX630 1MB/96KB CAN LQFP176 - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 32BIT 1MB FLASH 176LQFP
R5F5630BDDFP 制造商:RENESAS 制造商全称:Renesas Technology Corp 功能描述:Renesas MCUs
R5F5630BDDFP#V0 制造商:Renesas Electronics Corporation 功能描述:RX630 1MB, 96KB LQFP100 100MHZ - Trays 制造商:Renesas Electronics Corporation 功能描述:IC MCU 32BIT 1MB FLASH 100LQFP