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参数资料
| 型号： | R5F71242N50FP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 32-BIT, FLASH, 50 MHz, RISC MICROCONTROLLER, PQFP48 |
| 封装： | 10 X 10 MM, 0.65 MM PITCH, PLASTIC, LQFP-48 |
| 文件页数： | 239/595页 |
| 文件大小： | 4787K |
| 代理商： | R5F71242N50FP |
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Section 10 Interrupt Controller (INTC)
Rev.1.00 Dec. 13, 2005 Page 265 of 1286
REJ09B0158-0100
Bit
Name
Initial
Value
R/W
Description
11
IM111
0
R/W
Sets masking of interrupt-
request generation by
IRL7
to
IRL4 = LHLL (H'4).
10
IM110
0
R/W
Sets masking of interrupt-
request generation by
IRL7
to
IRL4 = LHLH (H'5).
9
IM109
0
R/W
Sets masking of interrupt-
request generation by
IRL7
to
IRL4 = LHHL (H'6).
8
IM108
0
R/W
Sets masking of interrupt-
request generation by
IRL7
to
IRL4 = LHHH (H'7).
[When reading]
0: The interrupt is
acceptable.
1: The interrupt is
masked.
[When wswriting]
0: No effect
1: Masks the interrupt
Initial value: 0
7
IM107
0
R/W
Sets masking of interrupt-
request generation by
IRL7
to
IRL4 = HLLL (H'8).
6
IM106
0
R/W
Sets masking of interrupt-
request generation by
IRL7
to
IRL4 = HLLH (H'9).
5
IM105
0
R/W
Sets masking of interrupt-
request generation by
IRL7
to
IRL4 = HLHL (H'A).
4
IM104
0
R/W
Sets masking of interrupt-
request generation by
IRL7
to
IRL4 = HLHH (H'B).
3
IM103
0
R/W
Sets masking of interrupt-
request generation by
IRL7
to
IRL4 = HHLL (H'C).
2
IM102
0
R/W
Sets masking of interrupt-
request generation by
IRL7
to
IRL4 = HHLH (H'D).
1
IM101
0
R/W
Sets masking of interrupt-
request generation by
IRL7
to
IRL4 = HHHL (H'E).
0
—
0
R
Reserved
This bit is always read as 0. The write value should
always be 0.
Note:
‘H’ and ‘L’ indicate high- and low-level input on the corresponding IRQ/
IRL pin. For the
relationship between the input signal level and the priority level, refer to table 10.11.
相关PDF资料 |
PDF描述 |
|---|---|
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相关代理商/技术参数 |
参数描述 |
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