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参数资料
| 型号： | RCPXA270C0C520 |
| 厂商： | MARVELL SEMICONDUCTOR INC |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 520 MHz, MICROPROCESSOR, PBGA356 |
| 封装： | 13 X 13 MM, 1 MM HEIGHT, 0.50 MM PITCH, VFBGA-356 |
| 文件页数： | 10/128页 |
| 文件大小： | 1560K |
| 代理商： | RCPXA270C0C520 |
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Electrical, Mechanical, and Thermal Specification
6-43
Intel PXA270 Processor
AC Timing Specifications
6.5
LCD Timing Specifications
Figure 6-28 describes the LCD timing parameters. The LCD pin timing specifications are
referenced to the pixel clock (L_PCLK_WR). Table 6-22 gives the values for the parameters.
Figure 6-28. LCD Timing Definitions
Table 6-22. LCD Timing Specifications
Symbol
Description
Min
Max
Units
Notes
Tpclkdv
L_PCLK_WR rise/fall to L_LDD<17:0>
driven valid
—
14
ns
1
Tpclklv
L_PCLK_WR fall to L_LCLK_A0 driven
valid
—
14
ns
2
Tpclkfv
L_PCLK_WR fall to L_FCLK_RD driven
valid
—
14
ns
2
Tpclkbv
L_PCLK_WR rise to L_BIAS driven valid
—
14
ns
2
NOTES:
1. The LCD data pins can be programmed to be driven on either the rising or falling edge of the pixel clock
(L_PCLK_WR).
2. These LCD signals can toggle when L_PCLK_WR is not clocking (between frames). At this time, they are
clocked with the internal version of the pixel clock before it is driven out onto the L_PCLK_WR pin.
L_LDD[17:0]
(rise)
L_LDD[17:0]
(fall)
L_PCLK_WR
L_LCLK_A0
L_BIAS
L_FCLK_RD
Tpclkdv
Tpclklv
Tpclkfv
Tpclkbv
Tpclkdv
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| RCQ50110S15 | 功能描述:DC-DC CONV, RAILWAY, 50W 制造商:xp power 系列:RCQ 包装:散装 零件状态:有效 类型:隔离模块 输出数:1 电压 - 输入（最小值）:66V 电压 - 输入（最大值）:160V 电压 - 输出 1:15V 电压 - 输出 2:- 电压 - 输出 3:- 电流 - 输出（最大值）:3.33A 功率（W） - 制造系列:50W 电压 - 隔离:3kV（3000V） 应用:ITE（商业），铁路 特性:远程开/关 安装类型:通孔 封装/外壳:8-DIP 模块 大小/尺寸:2.28" 长 x 1.45" 宽 x 0.50" 高（57.9mm x 36.8mm x 12.7mm） 工作温度:-40°C ~ 35°C 效率:92% 功率（W） - 最大值:50W 标准包装:1 |
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