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参数资料
型号： S1C17651B00E10A
元件分类： 微控制器/微处理器
英文描述： 16-BIT, FLASH, 2 MHz, RISC MICROCONTROLLER, PBGA
文件页数： 58/216页
文件大小： 1784K
代理商： S1C17651B00E10A
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17 LCD DRIVER (LCD)
S1C17651 TECHNICAL MANUAL
Seiko Epson Corporation
17-9
LCD Interrupt
17.7
The LCD module includes a function for generating interrupts using the frame signal.
Frame interrupt
This cause of interrupt occurs every frame and sets the interrupt flag IFRMFLG/LCD_IFLG register in the
LCD module to 1. See Figures 17.4.2.1 to 17.4.2.4 for interrupt timings.
To use this interrupt, set IFRMEN/LCD_IMSK register to 1. When IFRMEN is set to 0 (default), interrupt re-
quests for this interrupt cause are not sent to the interrupt controller (ITC).
If IFRMFLG is set to 1 while IFRMEN is set to 1 (interrupt enabled), the LCD module outputs an interrupt re-
quest to the ITC. An interrupt is generated if the ITC and S1C17 Core interrupt conditions are satisfied.
For more information on interrupt processing, see the “Interrupt Controller (ITC)” chapter.
Notes: To prevent interrupt recurrences, the LCD module interrupt flag IFRMFLG must be reset in the
interrupt handler routine after an LCD interrupt has occurred.
To prevent unwanted interrupts, IFRMFLG should be reset before enabling LCD interrupts with
IFRMEN.
Control Register Details
17.8
8.1 List of LCD Registers
Table 17.
Address
Register name
Function
0x5070
LCD_TCLK
LCD Clock Select Register
Selects the LCD clock.
0x50a0
LCD_DCTL
LCD Display Control Register
Controls the LCD display.
0x50a2
LCD_CCTL
LCD Clock Control Register
Controls the LCD drive duty.
0x50a3
LCD_VREG
LCD Voltage Regulator Control Register
Controls the LCD drive voltage regulator.
0x50a5
LCD_IMSK
LCD Interrupt Mask Register
Enables/disables interrupts.
0x50a6
LCD_IFLG
LCD Interrupt Flag Register
Indicates/resets interrupt occurrence status.
The LCD module registers are described in detail below.
Note: When data is written to the registers, the “Reserved” bits must always be written as 0 and not 1.
LCD Timing Clock Select Register (LCD_TCLK)
Register name Address
Bit
Name
Function
Setting
Init. R/W
Remarks
LCD Timing
Clock Select
Register
(LCD_TCLK)
0x5070
(8 bits)
D7–6 –
reserved
–
0 when being read.
D5–4 LCDTCLKD
[1:0]
LCD clock division ratio select
LCDTCLKD
[1:0]
Division ratio
0x0 R/W
OSC3B/
OSC3A
OSC1
0x3
0x2
0x1
0x0
1/8192
1/4096
1/2048
1/1024
1/64
D3–2 LCDTCLK
SRC[1:0]
LCD clock source select
LCDTCLK
SRC[1:0]
Clock source
0x0 R/W
0x3
0x2
0x1
0x0
reserved
OSC3A
OSC1
OSC3B
D1
–
reserved
–
0 when being read.
D0
LCDTCLKE LCD clock enable
1 Enable
0 Disable
0
R/W
D[7:6]
Reserved
D[5:4]
LCDTCLKD[1:0]: LCD Clock Division Ratio Select Bits
Selects the division ratio when OSC3B or OSC3A is selected as the LCD clock source.
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