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参数资料
| 型号： | S1R72005F00A300 |
| 元件分类： | 总线控制器 |
| 英文描述： | UNIVERSAL SERIAL BUS CONTROLLER, PQFP64 |
| 封装： | QFP-64 |
| 文件页数： | 16/47页 |
| 文件大小： | 461K |
| 代理商： | S1R72005F00A300 |
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7. Electrical Characteristics
S1R72005B00A300/F00A300
EPSON
17
Technical Manual (Rev.1.0)
7.4.2
CPU Interface Access Timing
7.4.2.1 Read Timing (External xWAIT Mode)
CA[7:0]
xCS
xRD
xWR
xWAIT
xDACK
Valid
T201
T202
T203
T204
T205
T206
T207
T208
T209
T20a
T20b
T20c
T20d
READYxWAIT
CD[15:0]
Stable
Symbol Description
Min.
Typ.
Max.
Unit
T201
xCS assert time relative to xDACK negate
10
-
ns
T202
xRD assert time relative to xCS assert
0
-
ns
T203
CD valid data delay time relative to xRD assert (Note 1)
-
62.5
ns
T204
xWAIT negate time relative to CD output
20
-
ns
T205
CD output hold time relative to xRD negate
2.5
-
ns
T206
xRD negate time relative to xWAIT negate
0
-
ns
T207
xRD negate time
25
-
ns
T208
xCS negate time relative to xRD negate
0
-
ns
T209
CA setup time relative to xRD assert
0
-
ns
T20a
CA hold time relative to xRD negate
0
-
ns
T20b
xDACK assert time relative to xCS negate
10
-
ns
T20c
xWAIT assert time relative to xRD assert
-
8
ns
T20d
CD output delay time relative to xRD assert
-
8
ns
Note 1:
This delay is stipulated for ordinary register access (not including access to the “FIFOforCPU” register). The data
output delay time may be extended during access to the FIFOforCPU register, depending on contention for access
to internal FIFO memory.
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PDF描述 |
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相关代理商/技术参数 |
参数描述 |
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| S1R72805F00A2 | 功能描述:IC LINK CTRLR 1394 IDE100 100QFP RoHS:否 类别:集成电路 (IC) >> 接口 - 控制器 系列:- 标准包装:4,900 系列:- 控制器类型:USB 2.0 控制器 接口:串行 电源电压:3 V ~ 3.6 V 电流 - 电源:135mA 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:36-VFQFN 裸露焊盘 供应商设备封装:36-QFN（6x6） 包装:* 其它名称:Q6396337A |
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| S1R72901F00A200 | 功能描述:IC PHY CONT 2PORT 1394A 100-QFP RoHS:否 类别:集成电路 (IC) >> 接口 - 控制器 系列:- 标准包装:4,900 系列:- 控制器类型:USB 2.0 控制器 接口:串行 电源电压:3 V ~ 3.6 V 电流 - 电源:135mA 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:36-VFQFN 裸露焊盘 供应商设备封装:36-QFN（6x6） 包装:* 其它名称:Q6396337A |
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