参数资料
型号: S1R72005F00A300
元件分类: 总线控制器
英文描述: UNIVERSAL SERIAL BUS CONTROLLER, PQFP64
封装: QFP-64
文件页数: 20/47页
文件大小: 461K
代理商: S1R72005F00A300
7. Electrical Characteristics
S1R72005B00A300/F00A300
EPSON
21
Technical Manual (Rev.1.0)
7.4.2.5 Read Timing (Fixed WAIT Mode)
CA[7:0]
xCS
xRD
xWR
xDACK
Valid
T241
T242
T243
T245
T247
T248
T249
T24a
T24b
T24d
CD[15:0]
Stable
Symbol Description
Min.
Typ.
Max.
Unit
T241
xCS assert time relative to xDACK negate
10
-
ns
T242
xRD assert time relative to xCS assert
0
-
ns
T243
CD valid data output delay time relative to xRD assert
-
110
ns
T244
-
ns
T245
CD output hold time relative to xRD negate
2.5
-
ns
T246
-
ns
T247
xRD negate period
25
-
ns
T248
xCS negate time relative to xRD negate
0
-
ns
T249
CA valid delay time relative to xRD assert
-
10
ns
T24a
CA hold time relative to xRD negate
0
-
ns
T24b
xDACK assert time relative to xCS negate
10
-
ns
T24c
-
ns
T24d
CD output delay time relative to xRD assert
-
8
ns
The S1R72005’s CPUConfig register is used to select fixed WAIT mode.
This LSI is designed to operate in external xWAIT mode after power-on reset.
Since xWAIT is not output during access to the CPUConfig register, data can be written to the register from a
CPU that does not have xWAIT.
If the external WAIT pin is unused, the CPU must be assigned an appropriate software wait when accessing, to
ensure that it can access this device with the above timing.
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