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参数资料
| 型号： | S29GL256N10FFI013 |
| 厂商： | SPANSION LLC |
| 元件分类： | PROM |
| 英文描述： | MirrorBit Flash Family |
| 中文描述： | 16M X 16 FLASH 3V PROM, 100 ns, PBGA64 |
| 封装： | 13 X 11 MM, LEAD FREE, FBGA-64 |
| 文件页数： | 83/95页 |
| 文件大小： | 3781K |
| 代理商： | S29GL256N10FFI013 |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页第81页第82页当前第83页第84页第85页第86页第87页第88页第89页第90页第91页第92页第93页第94页第95页
84
S29GL-N
S29GL-N_00_B8 May 30, 2008
Da ta
Sh e e t
19. Advance Information on S29GL-P Hardware Reset (RESET#) and Power-
up Sequence
Note
CE#, OE# and WE# must be at logic high during Reset Time.
Figure 19.1 Reset Timings
Table 19.1 Hardware Reset (RESET#)
Parameter
Description
Speed
Unit
JEDEC
Std.
tReady
RESET# Pin Low (During Embedded Algorithms) to
Read Mode or Write mode
Min
35
s
tReady
RESET# Pin Low (NOT During Embedded Algorithms)
to Read Mode or Write mode
Min
35
s
tRP
RESET# Pulse Width
Min
35
s
tRH
Reset High Time Before Read
Min
200
ns
tRPD
RESET# Low to Standby Mode
Min
10
s
tRB
RY/BY# Recovery Time
Min
0
ns
RESET#
RY/BY#
tRP
tReady
Reset Timings NOT during Embedded Algorithms
tReady
CE#, OE#
tRH
CE#, OE#
Reset Timings during Embedded Algorithms
RESET#
tRP
tRB
tRH
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PDF描述 |
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