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参数资料
| 型号： | S80C196EA |
| 厂商： | INTEL CORP |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MICROCONTROLLER, PQFP16 |
| 封装： | QFP-160 |
| 文件页数： | 17/32页 |
| 文件大小： | 869K |
| 代理商： | S80C196EA |
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80C196EA -
Commercial
20
Preliminary Datasheet
6.4
Deferred Bus Timing Mode
Deferred Bus Cycle Mode: This bus mode (enabled by setting CCB1.5) reduces bus contention
when using the 80C196EA in demultiplexed mode with slow memories. As shown in Figure 8, a
delay of 2t occurs in the first bus cycle following a chip-select output change and the first write
cycle following a read cycle.
Figure 8. Deferred Bus Mode Timing Diagram
CLKOUT
ALE
RD#
A3246-02
TWHLH + 2t
TRHLH + 2t
TAVRL + 2t
TAVWL + 2t
AD15:0
(read)
WR#
AD15:0
(write)
BHE#, INST
A20:0
CS
x#
TAVDV+ 2t
TLHLH + 2t
Data In
Data Out
Valid
Data Out
Address Out
Data Out
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