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参数资料
| 型号： | S9S08AW16AE0CFT |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 194/324页 |
| 文件大小： | 0K |
| 描述： | MCU 16K FLASH AUTO 48-QFN |
| 标准包装： | 260 |
| 系列： | S08 |
| 核心处理器： | S08 |
| 芯体尺寸： | 8-位 |
| 速度： | 40MHz |
| 连通性： | I²C，SCI，SPI |
| 外围设备： | LVD. POR，PWM，WDT |
| 输入/输出数： | 38 |
| 程序存储器容量： | 16KB（16K x 8） |
| 程序存储器类型： | 闪存 |
| RAM 容量： | 1K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 数据转换器： | A/D 8x10b |
| 振荡器型： | 内部 |
| 工作温度： | -40°C ~ 85°C |
| 封装/外壳： | 48-VFQFN 裸露焊盘 |
| 包装： | 托盘 |
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Chapter 15 Development Support
MC9S08AW60 Data Sheet, Rev 2
Freescale Semiconductor
273
A force-type breakpoint waits for the current instruction to nish and then acts upon the breakpoint
request. The usual action in response to a breakpoint is to go to active background mode rather than
continuing to the next instruction in the user application program.
The tag vs. force terminology is used in two contexts within the debug module. The rst context refers to
breakpoint requests from the debug module to the CPU. The second refers to match signals from the
comparators to the debugger control logic. When a tag-type break request is sent to the CPU, a signal is
entered into the instruction queue along with the opcode so that if/when this opcode ever executes, the CPU
will effectively replace the tagged opcode with a BGND opcode so the CPU goes to active background
mode rather than executing the tagged instruction. When the TRGSEL control bit in the DBGT register is
set to select tag-type operation, the output from comparator A or B is qualied by a block of logic in the
debug module that tracks opcodes and only produces a trigger to the debugger if the opcode at the compare
address is actually executed. There is separate opcode tracking logic for each comparator so more than one
compare event can be tracked through the instruction queue at a time.
15.3.5
Trigger Modes
The trigger mode controls the overall behavior of a debug run. The 4-bit TRG eld in the DBGT register
selects one of nine trigger modes. When TRGSEL = 1 in the DBGT register, the output of the comparator
must propagate through an opcode tracking circuit before triggering FIFO actions. The BEGIN bit in
DBGT chooses whether the FIFO begins storing data when the qualied trigger is detected (begin trace),
or the FIFO stores data in a circular fashion from the time it is armed until the qualied trigger is detected
(end trigger).
A debug run is started by writing a 1 to the ARM bit in the DBGC register, which sets the ARMF ag and
clears the AF and BF ags and the CNT bits in DBGS. A begin-trace debug run ends when the FIFO gets
full. An end-trace run ends when the selected trigger event occurs. Any debug run can be stopped manually
by writing a 0 to ARM or DBGEN in DBGC.
In all trigger modes except event-only modes, the FIFO stores change-of-ow addresses. In event-only
trigger modes, the FIFO stores data in the low-order eight bits of the FIFO.
The BEGIN control bit is ignored in event-only trigger modes and all such debug runs are begin type
traces. When TRGSEL = 1 to select opcode fetch triggers, it is not necessary to use R/W in comparisons
because opcode tags would only apply to opcode fetches that are always read cycles. It would also be
unusual to specify TRGSEL = 1 while using a full mode trigger because the opcode value is normally
known at a particular address.
The following trigger mode descriptions only state the primary comparator conditions that lead to a trigger.
Either comparator can usually be further qualied with R/W by setting RWAEN (RWBEN) and the
corresponding RWA (RWB) value to be matched against R/W. The signal from the comparator with
optional R/W qualication is used to request a CPU breakpoint if BRKEN = 1 and TAG determines
whether the CPU request will be a tag request or a force request.
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PDF描述 |
|---|---|
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| VI-B3K-IY-B1 | CONVERTER MOD DC/DC 40V 50W |
| VI-B3J-IY-B1 | CONVERTER MOD DC/DC 36V 50W |
| VI-B3H-IY-B1 | CONVERTER MOD DC/DC 52V 50W |
相关代理商/技术参数 |
参数描述 |
|---|---|
| S9S08AW16AE0CFTR | 功能描述:8位微控制器 -MCU 16K FLASH,1K RAM, 48PINS RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| S9S08AW16AE0CLC | 制造商:Freescale Semiconductor 功能描述:MCU 8BIT HCS08 CISC 16KB FLASH 3.3V/5V 32LQFP - Bulk 制造商:Freescale Semiconductor 功能描述:16K FLASH 1K RAM 32 PINS |
| S9S08AW16AE0CLCR | 制造商:Freescale Semiconductor 功能描述:MCU 8BIT HCS08 CISC 16KB FLASH 3.3V/5V 32LQFP - Tape and Reel |
| S9S08AW16AE0CLD | 功能描述:8位微控制器 -MCU 16K FLASH,1K RAM 44 PINS RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| S9S08AW16AE0CLDR | 制造商:Freescale Semiconductor 功能描述:MCU 8BIT HCS08 CISC 16KB FLASH 3.3V/5V 44LQFP - Tape and Reel |
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