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参数资料
| 型号： | S9S08DZ32F1MLH |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 315/416页 |
| 文件大小： | 0K |
| 描述： | MCU 32K FLASH MASK AUTO 64-LQFP |
| 标准包装： | 160 |
| 系列： | S08 |
| 核心处理器： | S08 |
| 芯体尺寸： | 8-位 |
| 速度： | 40MHz |
| 连通性： | CAN，I²C，LIN，SCI，SPI |
| 外围设备： | LVD，POR，PWM，WDT |
| 输入/输出数： | 53 |
| 程序存储器容量： | 32KB（32K x 8） |
| 程序存储器类型： | 闪存 |
| EEPROM 大小： | 1K x 8 |
| RAM 容量： | 2K x 8 |
| 电压 - 电源 (Vcc/Vdd)： | 2.7 V ~ 5.5 V |
| 数据转换器： | A/D 24x12b |
| 振荡器型： | 外部 |
| 工作温度： | -40°C ~ 125°C |
| 封装/外壳： | 64-LQFP |
| 包装： | 托盘 |
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Appendix A Electrical Characteristics
MC9S08DZ60 Series Data Sheet, Rev. 4
382
Freescale Semiconductor
18
T
RMS frequency variation of a single clock cycle
measured 625 ns after reference edge.6
fpll_cycjit_625ns
—
0.5664
—
%fpll
19
T
Maximum frequency variation averaged over
625 ns window.
fpll_maxjit_625ns
—
0.113
—
%fpll
20
D Lock entry frequency tolerance 7
Dlock
± 1.49
—
± 2.98
%
21
D Lock exit frequency tolerance 8
Dunl
± 4.47
—
± 5.97
%
22
D Lock time - FLL
tl_lock
——
tl_acquire+
1075(1/fint_t)
s
23
D Lock time - PLL
tpll_lock
——
tpll_acquire+
1075(1/fpll_ref)
s
24
D
Loss of external clock minimum frequency -
RANGE = 0
floc_low
(3/5) x fint
—
kHz
25
D
Loss of external clock minimum frequency -
RANGE = 1
floc_high
(16/5) x fint
—
kHz
1 TRIM register at default value (0x80) and FTRIM control bit at default value (0x0).
2 This specication applies to any time the FLL reference source or reference divider is changed, trim value changed or
changing from FLL disabled (BLPE, BLPI) to FLL enabled (FEI, FEE, FBE, FBI). If a crystal/resonator is being used as the
reference, this specication assumes it is already running.
3 This specication applies to any time the PLL VCO divider or reference divider is changed, or changing from PLL disabled
(BLPE, BLPI) to PLL enabled (PBE, PEE). If a crystal/resonator is being used as the reference, this specication assumes it
is already running.
4 Jitter is the average deviation from the programmed frequency measured over the specied interval at maximum f
BUS.
Measurements are made with the device powered by ltered supplies and clocked by a stable external clock signal. Noise
injected into the FLL circuitry via VDD and VSS and variation in crystal oscillator frequency increase the CJitter percentage for
a given interval. Jitter measurements are based upon a 40MHz MCGOUT clock frequency.
5 In some specications, this value is described as “long term accuracy of PLL output clock (averaged over 2 ms)” with symbol
“fpll_jitter_2ms.” The parameter is unchanged, but the description has been changed for clarication purposes.
6 In some specications, this value is described as “Jitter of PLL output clock measured over 625 ns” with symbol
“fpll_jitter_625ns.” The parameter is unchanged, but the description has been changed for clarication purposes.
7 Below D
lock minimum, the MCG is guaranteed to enter lock. Above Dlock maximum, the MCG will not enter lock. But if the
MCG is already in lock, then the MCG may stay in lock.
8 Below D
unl minimum, the MCG will not exit lock if already in lock. Above Dunl maximum, the MCG is guaranteed to exit lock.
Table A-12. MCG Frequency Specications (Temperature Range = –40 to 125
°C Ambient) (continued)
Num
C
Rating
Symbol
Min
Typical
Max
Unit
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相关代理商/技术参数 |
参数描述 |
|---|---|
| S9S08DZ32F1VLCR | 制造商:Freescale Semiconductor 功能描述: |
| S9S08DZ32F1VLHR | 制造商:Freescale Semiconductor 功能描述: |
| S9S08DZ48F1CLF | 制造商:FREESCALE 制造商全称:Freescale Semiconductor, Inc 功能描述:S9S08DZ48F1CLF |
| S9S08DZ48F1CLH | 功能描述:8位微控制器 -MCU 48K FLASH, 3K RAM, EEPRO RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
| S9S08DZ48F1MLC | 功能描述:8位微控制器 -MCU M74K MASK ONLY-AUTO RoHS:否 制造商:Silicon Labs 核心:8051 处理器系列:C8051F39x 数据总线宽度:8 bit 最大时钟频率:50 MHz 程序存储器大小:16 KB 数据 RAM 大小:1 KB 片上 ADC:Yes 工作电源电压:1.8 V to 3.6 V 工作温度范围:- 40 C to + 105 C 封装 / 箱体:QFN-20 安装风格:SMD/SMT |
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