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参数资料
| 型号： | SAF-C164SL-8RM |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, MROM, 20 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 0.65 MM PITCH, METRIC, PLASTIC, QFP-80 |
| 文件页数： | 60/79页 |
| 文件大小： | 1314K |
| 代理商： | SAF-C164SL-8RM |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页当前第60页第61页第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页
C164CI/SI
C164CL/SL
Data Sheet
59
V2.0, 2001-05
RD, WR low time
(no RW-delay)
t13 CC 50 + tC
–
3TCL - 10
+
tC
–
ns
RD to valid data in
(with RW-delay)
t14 SR –
20 +
tC
–
2TCL - 20
+
tC
ns
RD to valid data in
(no RW-delay)
t15 SR –
40 +
tC
–
3TCL - 20
+
tC
ns
ALE low to valid data in
t16 SR –
40 +
tA
+
tC
–
3TCL - 20
+
tA + tC
ns
Address to valid data in
t17 SR –
50 + 2
tA
+
tC
–
4TCL - 30
+ 2
tA + tC
ns
Data hold after RD
rising edge
t18 SR 0
–
0
–
ns
Data float after RD
t19 SR –
26 +
tF
–
2TCL - 14
+
tF
ns
Data valid to WR
t22 CC 20 + tC
–
2TCL - 20
+
tC
–
ns
Data hold after WR
t23 CC 26 + tF
–
2TCL - 14
+
tF
–
ns
ALE rising edge after RD,
WR
t25 CC 26 + tF
–
2TCL - 14
+
tF
–
ns
Address hold after RD,
WR
t27 CC 26 + tF
–
2TCL - 14
+
tF
–
ns
ALE falling edge to CS1)
t38 CC -4 - tA
10 -
tA
-4 -
tA
10 -
tA
ns
CS low to Valid Data In1)
t39 SR –
40
+
tC
+ 2
tA
–
3TCL - 20
+
tC + 2tA
ns
CS hold after RD, WR1)
t40 CC 46 + tF
–
3TCL - 14
+
tF
–
ns
ALE fall. edge to RdCS,
WrCS (with RW delay)
t42 CC 16 + tA
–
TCL - 4
+
tA
–
ns
Multiplexed Bus (cont’d)
(Operating Conditions apply)
ALE cycle time = 6 TCL + 2
tA + tC + tF (120 ns at 25 MHz CPU clock without waitstates)
Parameter
Symbol
Max. CPU Clock
= 25 MHz
Variable CPU Clock
1 / 2TCL = 1 to 25 MHz
Unit
min.
max.
min.
max.
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PDF描述 |
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