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参数资料
| 型号： | SAK-C164CI-8EMCB |
| 厂商： | INFINEON TECHNOLOGIES AG |
| 元件分类： | 微控制器/微处理器 |
| 英文描述： | 16-BIT, OTPROM, 20 MHz, MICROCONTROLLER, PQFP80 |
| 封装： | 0.65 MM PITCH, METRIC, PLASTIC, QFP-80 |
| 文件页数： | 62/80页 |
| 文件大小： | 1337K |
| 代理商： | SAK-C164CI-8EMCB |
第1页第2页第3页第4页第5页第6页第7页第8页第9页第10页第11页第12页第13页第14页第15页第16页第17页第18页第19页第20页第21页第22页第23页第24页第25页第26页第27页第28页第29页第30页第31页第32页第33页第34页第35页第36页第37页第38页第39页第40页第41页第42页第43页第44页第45页第46页第47页第48页第49页第50页第51页第52页第53页第54页第55页第56页第57页第58页第59页第60页第61页当前第62页第63页第64页第65页第66页第67页第68页第69页第70页第71页第72页第73页第74页第75页第76页第77页第78页第79页第80页
C164CI/SI
C164CL/SL
Data Sheet
60
V2.0, 2001-05
ALE fall. edge to RdCS,
WrCS (no RW delay)
t43 CC -4 + tA
–
-4
+
tA
–
ns
Address float after RdCS,
WrCS (with RW delay)
t44 CC –
0
–
0ns
Address float after RdCS,
WrCS (no RW delay)
t45 CC –
20
–
TCL
ns
RdCS to Valid Data In
(with RW delay)
t46 SR –
16 +
tC
–
2TCL - 24
+
tC
ns
RdCS to Valid Data In
(no RW delay)
t47 SR –
36 +
tC
–
3TCL - 24
+
tC
ns
RdCS, WrCS Low Time
(with RW delay)
t48 CC 30 + tC
–
2TCL - 10
+
tC
–
ns
RdCS, WrCS Low Time
(no RW delay)
t49 CC 50 + tC
–
3TCL - 10
+
tC
–
ns
Data valid to WrCS
t50 CC 26 + tC
–
2TCL - 14
+
tC
–
ns
Data hold after RdCS
t51 SR 0
–
0
–
ns
Data float after RdCS
t52 SR –
20 +
tF
–
2TCL - 20
+
tF
ns
Address hold after
RdCS, WrCS
t54 CC 20 + tF
–
2TCL - 20
+
tF
–
ns
Data hold after WrCS
t56 CC 20 + tF
–
2TCL - 20
+
tF
–
ns
1) These parameters refer to the latched chip select signals (CSxL). The early chip select signals (CSxE) are
specified together with the address and signal BHE (see figures below).
Multiplexed Bus (cont’d)
(Operating Conditions apply)
ALE cycle time = 6 TCL + 2
tA + tC + tF (120 ns at 25 MHz CPU clock without waitstates)
Parameter
Symbol
Max. CPU Clock
= 25 MHz
Variable CPU Clock
1 / 2TCL = 1 to 25 MHz
Unit
min.
max.
min.
max.
相关PDF资料 |
PDF描述 |
|---|---|
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参数描述 |
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