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参数资料
| 型号： | SCE5785 |
| 厂商： | SIEMENS A G |
| 元件分类： | 显示用LED |
| 英文描述： | 5X7 DOT MATRIX DISPLAY, SOFT ORANGE, 4.57 mm |
| 封装： | PLASTIC, DIP-26 |
| 文件页数： | 4/13页 |
| 文件大小： | 295K |
| 代理商： | SCE5785 |
2–198
SCE5780/1/2/3/4/5
Figure 12. Display Interface to Siemens/Intel 8031 Microprocessor (using serial port in mode 0)
Figure 13. Display Interface to Siemens/Intel 8031 Microprocessor (using one bit of parallel port as serial port)
Figure 14. Display Interface with Motoroal 68HC05C4 Microprocessor (using SPI Port)
Figure 15. Cascading Multiple Displays
Multiple displays can be cascaded using the CLK SEL and CLK I/O pins (Figure 15). The display designated as the Master-
Clock source should have its CLK SEL pin tied high and the slaves should have their CLK SEL pins tied low. All CLK I/O pins
should be tied together. One display CLK I/O can drive 15 slave CLK I/Os. Use RST to synchronize all display counters.
VCC
U1
8031
9 RST
18
19
XTAL2
XTAL1
40
RXD
TXD
10
11
10
21
8
22
f
TAN
.01
f
P3.7 17
P3.3 13
P3.4 14
GND
DATA
VCC
CLKSEL
CLK I/O
SDCLK
LD
RST
GND
ID
+
15
13
19
2
14
VCC
U1
8031
1
9
20
RST
P1.0
18
19
XTAL2
XTAL1
40 P3.0
P3.1
P3.6
P0.0
10
11
16
39
VCC
10
21
8
22
F
TAN
.01
F
GND
DATA
VCC
CLKSEL
CLK I/O
SDCLK
LD
RST
GND
ID
+
15
13
19
2
14
VCC
U1
68HC05C4
1
9
20
RST
PA2
38
39
OSC1
OSC2
40
PA0
PA1
SCLK
MOSI
11
10
33
32
VCC
10
21
8
22
F
TAN
.01
F
GND
DATA
VCC
CS
CLK I/O
SDCLK
LD
RST
GND
ID
+
15
13
19
2
14
RST
CLK I/O
CLK SEL
DATA
SDCLK
LOAD
14 more displays
in between
RST
CLK I/O
CLK SEL
DATA SDCLK
LOAD
Chip
Address
Decoder
0
15
Address Decode 1–14
VCC
RST
DATA
SDCLK
A0
A1
A2
A3
LD
Intelligent Display
CE
相关PDF资料 |
PDF描述 |
|---|---|
| SD103N16S15MV | 110 A, 1600 V, SILICON, RECTIFIER DIODE, DO-205AC |
| SD103N20S20MC | 110 A, 2000 V, SILICON, RECTIFIER DIODE, DO-205AC |
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| SD103R14S15PV | 110 A, 1400 V, SILICON, RECTIFIER DIODE, DO-205AC |
| SD153N04S10MV | 150 A, 400 V, SILICON, RECTIFIER DIODE, DO-205AC |
相关代理商/技术参数 |
参数描述 |
|---|---|
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