参数资料
型号: SI5322-B-GM
厂商: Silicon Laboratories Inc
文件页数: 4/24页
文件大小: 0K
描述: IC PREC CLOCK MULTIPLIER 36QFN
标准包装: 50
系列: DSPLL®
类型: 时钟乘法器
PLL:
输入: 时钟
输出: CML,CMOS,LVDS,LVPECL
电路数: 1
比率 - 输入:输出: 2:2
差分 - 输入:输出: 是/是
频率 - 最大: 1.05GHz
除法器/乘法器: 无/是
电源电压: 1.71 V ~ 3.63 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 36-VFQFN 裸露焊盘
供应商设备封装: 36-QFN(6x6)
包装: 管件
Si5322
12
Rev. 0.51
Figure 6. Si5322 Typical Application Circuit
Si5322
CS_CA
3
C1B
C2B
FRQSEL[3:0]
2
BWSEL[1:0]
2
SFOUT[1:0]
2
DBL2_BY
2
RST
CKOUT1+
CKOUT1–
VDD
GND
Input Clock Select/
Active Clock Indicator
Frequency Select
Bandwidth Select
Signal Format Select
Clock Output 2 Disable/
Bypass Mode Control
Reset
CKIN_1 Loss of Signal
CKIN_2 Loss of Signal
Clock
Outputs
FRQTBL
2
Frequency Table Select
CKOUT2+
CKOUT2–
AUTOSEL
2
Manual/Automatic Clock
Selection (L)
2. Denotes tri-level input pins with states designated as L (ground), M (VDD/2), and H (VDD).
CKIN1+
CKIN1–
Input
Clock
Sources
1
CKIN2+
CKIN2–
Notes:
3. Assumes manual input clock selection.
1. Assumes differential LVEPECL termination (3.3 V) on clock inputs.
Ferrite
Bead
System
Power
Supply
C3
C2
C1
C4
0.1 F
1 F
0.1 F
100
0.1 F
+
0.1 F
100
0.1 F
+
130
130
82
82
VDD = 3.3 V
130
130
82
82
VDD = 3.3 V
VDD
15 k
15 k
VDD
15 k
15 k
VDD
15 k
15 k
VDD
15 k
15 k
VDD
15 k
15 k
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PDF描述
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