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参数资料
| 型号： | SI5364-G-BC |
| 厂商： | Silicon Laboratories Inc |
| 文件页数： | 14/38页 |
| 文件大小： | 0K |
| 描述： | IC PREC PORT CARD CLOCK 99CBGA |
| 标准包装： | 176 |
| 系列： | DSPLL® |
| 类型： | 时钟发生器 |
| PLL： | 是 |
| 输入： | 时钟 |
| 输出： | CML |
| 电路数： | 1 |
| 比率 - 输入:输出： | 3:4 |
| 差分 - 输入:输出： | 是/是 |
| 频率 - 最大： | 675MHz |
| 除法器/乘法器： | 无/是 |
| 电源电压： | 3.135 V ~ 3.465 V |
| 工作温度： | -20°C ~ 85°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 99-BCBGA |
| 供应商设备封装： | 99-CBGA（11x11） |
| 包装： | 托盘 |
| 其它名称： | 336-1280 |
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Si5364
Rev. 2.5
21
and are also used for connection of the external
compensation circuit.
The compensation circuit for the internal voltage
regulator consists of a resistor and a capacitor in series
between the VDD25 node and ground. In practice, if a
capacitor is selected with an appropriate equivalent
series resistance (ESR), the discrete series resistor can
be eliminated. The target RC time constant for this
combination is 15 to 50 s. The capacitor used in the
Si5364 evaluation board is a 33 F tantalum capacitor
with an ESR of 0.8
Ω. This gives an RC time constant of
26.4 s and no discrete resistor is required. (See
The Venkel part number,
TA6R3TCR336KBR, is an example of a capacitor that
meets these specifications.
To get optimal performance from the Si5364 device, the
power supply noise spectrum must comply with the plot
in Figure 13. This plot shows the power supply noise
tolerance mask for the Si5364. The customer should
provide a 3.3 V supply that does not have noise density
in excess of the amount shown in the diagram.
However, the diagram cannot be used as spur criteria
for a power supply that contains single tone noise.
2.13. Design and Layout Guidelines
Precision clock circuits are susceptible to board noise
and EMI. To take precautions against unacceptable
levels of board noise and EMI affecting performance of
the Si5364, consider the following:
Use an isolated, local plane to connect the VDD25
pins. Avoid running signal traces over or below this
plane without a ground plane in between.
Route all I/O traces between ground planes as much
as possible
Maintain an input clock amplitude in the 200 mVPP to
500 mVPP differential range.
Excessive high-frequency harmonics of the input clock
should be minimized. The use of filters on the input
clock signal can be used to remove high-frequency
harmonics.
Figure 13. Power Supply Noise Tolerance Mask
f
Vn (μV/√Hz)
230
4.5
10 kHz
500 kHz
100 Mhz
相关PDF资料 |
PDF描述 |
|---|---|
| SI5364-H-BL | IC CLK MULT SONET/SDH 99-PBGA |
| SI5365-C-GQ | IC CLOCK MULTIPLIER PROG 100TQFP |
| SI5366-C-GQ | IC CLOCK MULTIPLIER PREC 100TQFP |
| SI5367A-C-GQ | IC CLOCK MULTIPLIER PROG 100TQFP |
| SI5368A-C-GQ | IC CLK MULTIPLIER ATTEN 100TQFP |
相关代理商/技术参数 |
参数描述 |
|---|---|
| Si5364-H-BL | 功能描述:时钟发生器及支持产品 SONET/SDH Prcsn Port Card Clock Multiplr RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
| Si5364-H-BLR | 功能描述:时钟发生器及支持产品 SONET/SDH Precision 19MHz 155MHz 622MHz RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
| Si5364-H-GL | 功能描述:时钟发生器及支持产品 SONET/SDH Prcsn Port Card Clock Multiplr RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
| Si5364-H-GLR | 功能描述:时钟发生器及支持产品 SONET/SDH Precision 19MHz 155MHz 622MHz RoHS:否 制造商:Silicon Labs 类型:Clock Generators 最大输入频率:14.318 MHz 最大输出频率:166 MHz 输出端数量:16 占空比 - 最大:55 % 工作电源电压:3.3 V 工作电源电流:1 mA 最大工作温度:+ 85 C 安装风格:SMD/SMT 封装 / 箱体:QFN-56 |
| SI5365 | 制造商:SILABS 制造商全称:SILABS 功能描述:PIN-PROGRAMMABLE PRECISION CLOCK MULTIPLIER |
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