参数资料
型号: SI5367A-C-GQR
厂商: Silicon Laboratories Inc
文件页数: 78/80页
文件大小: 0K
描述: IC CLOCK MULTIPLIER PROG 100TQFP
标准包装: 250
系列: DSPLL®
类型: 时钟乘法器
PLL:
输入: 时钟
输出: CML,CMOS,LVDS,LVPECL
电路数: 1
比率 - 输入:输出: 4:5
差分 - 输入:输出: 是/是
频率 - 最大: 1.42GHz
除法器/乘法器: 无/是
电源电压: 1.71 V ~ 2.75 V
工作温度: -40°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 100-TQFP
供应商设备封装: 100-TQFP(14x14)
包装: 带卷 (TR)
Si5367
8
Rev. 0.5
3-Level Input Pins6
Input Voltage Low
VILL
0.15 x VDD
V
Input Voltage Mid
VIMM
0.45 x VDD
—0.55 x VDD
V
Input Voltage High
VIHH
0.85 x VDD
——
V
Input Low Current
IILL
See Note 6
–20
A
Input Mid Current
IIMM
See Note 6
–2
+2
A
Input High Current
IIHH
See Note 6
20
A
LVCMOS Output Pins
Output Voltage Low
VOL
IO = 2 mA
VDD =1.71V
——
0.4
V
Output Voltage Low
IO = 2 mA
VDD =2.97V
——
0.4
V
Output Voltage High
VOH
IO = –2 mA
VDD =1.71V
VDD – 0.4
V
Output Voltage High
IO = –2 mA
VDD =2.97V
VDD – 0.4
V
Disabled Leakage
Current
IOZ
RSTb = 0
–100
100
A
Table 2. DC Characteristics (Continued)
(VDD = 1.8 ± 5%, 2.5 ±10%, or 3.3 V ±10%, TA = –40 to 85 °C)
Parameter
Symbol
Test Condition
Min
Typ
Max
Unit
Notes:
1. Current draw is independent of supply voltage.
2. The LVPECL and CMOS output formats draw more current than either LVDS or CML; however, there are restrictions in
the allowed output format pin settings so that the maximum power dissipation for the TQFP devices is limited when
they are operated at 3.3 V. When there are four enabled LVPECL or CMOS outputs, the fifth output must be disabled.
When there are five enabled outputs, there can be no more than three outputs that are either LVPECL or CMOS.
3. No under- or overshoot is allowed.
4. LVPECL outputs require nominal VDD
≥ 2.5 V.
5. LVPECL, CML, LVDS and low-swing LVDS measured with Fo = 622.08 MHz.
6. This is the amount of leakage that the 3-Level inputs can tolerate from an external driver. See Si53xx Family Reference
Manual for more details.
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