参数资料
型号: SL28540ALC
厂商: Silicon Laboratories Inc
文件页数: 7/25页
文件大小: 0K
描述: IC CLOCK CK540 LP MOBILE 56QFN
标准包装: 260
类型: 时钟/频率发生器
PLL:
主要目的: Intel CPU 服务器
输入: 晶体
输出: HCSL,LVCMOS
电路数: 1
比率 - 输入:输出: 1:17
差分 - 输入:输出: 无/是
频率 - 最大: 200MHz
电源电压: 3.135 V ~ 3.465 V
工作温度: 0°C ~ 85°C
安装类型: 表面贴装
封装/外壳: 56-VFQFN 裸露焊盘
供应商设备封装: 56-QFN(8x8)
包装: 托盘
SL28540
................................................... Document #: Page 15 of 25
PCI_STP# Assertion
The PCI_STP# signal is an active LOW input used for
synchronously stopping and starting the PCI outputs while the
rest of the clock generator continues to function. The set-up
time for capturing PCI_STP# going LOW is 10 ns (tSU). (See
Figure 9.) The PCIF clocks are affected by this pin if their
corresponding control bit in the SMBus register is set to allow
them to be free running.
.
PCI_STP# Deassertion
The deassertion of the PCI_STP# signal causes all PCI and
stoppable PCIF clocks to resume running in a synchronous
manner within two PCI clock periods, after PCI_STP# transi-
tions to a HIGH level.
.
Tsu
PC I_STP#
PC I_F
PC I
S RC 100M Hz
Figure 9. PCI_STP# Assertion Waveform
PC I_ STP#
PC I_ F
PC I
S RC 1 0 0 M H z
Tsu
Td rive _ S R C
Figure 10. PCI_STP# Deassertion Waveform
Table 6. Output Driver Status during PCI-STOP# and CPU-STOP#
PCI_STOP# Asserted
CPU_STOP# Asserted
SMBus OE Disabled
Single-ended Clocks
Stoppable
Driven low
Running
Driven low
Non stoppable
Running
Differential Clocks
Stoppable
Clock driven high
Clock driven Low or 20K
pulldown
Clock# driven low
Non stoppable
Running
Table 7. Output Driver Status
All Single-ended Clocks
All Differential Clocks except CPU1
CPU1
w/o Strap
w/ Strap
Clock
Clock#
Clock
Clock#
Latches Open State
Low
Hi-Z
Low or 20K pulldown
Low
Low or 20K
pulldown
Low
Powerdown
Low
Hi-Z
Low or 20K pulldown
Low
Low or 20K
pulldown
Low
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