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参数资料
| 型号： | SPAK56F8346FV60 |
| 厂商： | FREESCALE SEMICONDUCTOR INC |
| 元件分类： | 数字信号处理 |
| 英文描述： | 16-BIT, 240 MHz, OTHER DSP, PQFP144 |
| 封装： | 20 X 20 MM, 0.50 MM PITCH, 1.40 MM HEIGHT, PLASTIC, LQFP-144 |
| 文件页数： | 3/156页 |
| 文件大小： | 2219K |
| 代理商： | SPAK56F8346FV60 |
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100
56F8346 Technical Data
MOTOROLA
Preliminary
6.5.5
Least Significant Half of JTAG ID (SIM_LSH_ID)
This read-only register displays the least significant half of the JTAG ID for the chip. This register reads
$401D.
Figure 6-7 Least Significant Half of JTAG ID (SIM_LSH_ID)
6.5.6
SIM Pull-up Disable Register (SIM_PUDR)
Most of the pins on the chip have on-chip pull-up resistors. Pins which can operate as GPIO can have these
resistors disabled via the GPIO function. Non-GPIO pins can have their pull-ups disabled by setting the
appropriate bit in this register. Disabling pull-ups is done on a peripheral-by-peripheral basis (for pins not
muxed with GPIO). Each bit in the register (see Figure 6-8) corresponds to a functional group of pins. See
Table 2-2 to identify which pins can deactivate the internal pull-up resistor.
Figure 6-8 SIM Pull-up Disable Register (SIM_PUDR)
6.5.6.1
PWMA1
This bit controls the pull-up resistors on the FAULTA3 pin.
6.5.6.2
CAN
This bit controls the pull-up resistors on the CAN_RX pin.
6.5.6.3
EMI_MODE
This bit controls the pull-up resistors on the EMI_MODE pin.
6.5.6.4
RESET
This bit controls the pull-up resistors on the RESET pin.
6.5.6.5
IRQ
This bit controls the pull-up resistors on the IRQA and IRQB pins.
6.5.6.6
XBOOT
This bit controls the pull-up resistors on the EXTBOOT pin.
6.5.6.7
PWMB
This bit controls the pull-up resistors on the FAULTB0, FAULTB1, FAULTB2, and FAULTB3 pins.
Base + $7
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
1
0
00
0
1
101
Write
RESET
0
1
0
00
0
1
101
Base + $8
15
14
13
12
11
10
9
8
7
6
5
4
3
2
1
0
Read
0
PWMA1
CAN
EMI_
MODE
RESET
IRQ
XBOOT
PWMB
PWMA0
0
CTRL
0
JTAG
00
0
Write
RESET
00
0
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