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参数资料
| 型号： | SPAKDSP311VL150 |
| 厂商： | Freescale Semiconductor |
| 文件页数： | 17/96页 |
| 文件大小： | 0K |
| 描述： | IC DSP 24BIT 150MHZ 196-MAPBGA |
| 标准包装： | 2 |
| 系列： | DSP56K/Symphony |
| 类型： | 定点 |
| 接口： | 主机接口，SSI，SCI |
| 时钟速率： | 150MHz |
| 非易失内存： | ROM（576 B） |
| 芯片上RAM： | 384kB |
| 电压 - 输入/输出： | 3.30V |
| 电压 - 核心： | 1.80V |
| 工作温度： | -40°C ~ 100°C |
| 安装类型： | 表面贴装 |
| 封装/外壳： | 196-LBGA |
| 供应商设备封装： | 196-MAPBGA（15x15） |
| 包装： | 托盘 |
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DSP56311 Technical Data, Rev. 8
2-4
Freescale Semiconductor
Specifications
2.4 AC Electrical Characteristics
The timing waveforms shown in the AC electrical characteristics section are tested with a VIL maximum of 0.3 V
and a VIH minimum of 2.4 V for all pins except EXTAL, which is tested using the input levels shown in Note 6 of
Table 2-2. AC timing specifications, which are referenced to a device input signal, are measured in production with
respect to the 50 percent point of the respective input signal’s transition. DSP56311 output levels are measured
with the production test machine VOL and VOH reference levels set at 0.4 V and 2.4 V, respectively.
Note:
Although the minimum value for the frequency of EXTAL is 0 MHz, the device AC test conditions are 15
MHz and rated speed.
2.4.1
Internal Clocks
Table 2-4.
Internal Clocks
Characteristics
Symbol
Expression
Min
Typ
Max
Internal operation frequency with PLL
enabled
f—
(Ef
× MF)/
(PDF
× DF)
—
Internal operation frequency with PLL
disabled
f—
Ef/2
—
Internal clock high period
With PLL disabled
With PLL enabled and MF
≤4
With PLL enabled and MF > 4
TH
—
0.49
× ET
C ×
PDF
× DF/MF
0.47
× ETC ×
PDF
× DF/MF
ETC
—
0.51
× ET
C ×
PDF
× DF/MF
0.53
× ETC ×
PDF
× DF/MF
Internal clock low period
With PLL disabled
With PLL enabled and
MF
≤4
With PLL enabled and
MF > 4
TL
—
0.49
× ET
C ×
PDF
× DF/MF
0.47
× ETC ×
PDF
× DF/MF
ETC
—
0.51
× ET
C ×
PDF
× DF/MF
0.53
× ETC ×
PDF
× DF/MF
Internal clock cycle time with PLL enabled
TC
—ETC × PDF ×
DF/MF
—
Internal clock cycle time with PLL disabled
TC
—2
× ET
C
—
Instruction cycle time
ICYC
—TC
—
Notes:
1.
DF = Division Factor; Ef = External frequency; ETC = External clock cycle; MF = Multiplication Factor;
PDF = Predivision Factor; TC = internal clock cycle.
2.
See the PLL and Clock Generation section in the
DSP56300 Family Manual for a details on the PLL.
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PDF描述 |
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参数描述 |
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| SPAKDSP56824BU70 | 制造商:Freescale Semiconductor 功能描述: |
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