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参数资料
| 型号： | SSTUA32866EC,518 |
| 厂商： | NXP SEMICONDUCTORS |
| 元件分类： | 锁存器 |
| 英文描述： | 32866 SERIES, POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, PBGA96 |
| 封装： | 13.50 X 5.50 MM, 1.05 MM HEIGHT, PLASTIC, SOT-536-1, LFBGA-96 |
| 文件页数： | 22/28页 |
| 文件大小： | 153K |
| 代理商： | SSTUA32866EC,518 |
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SSTUA32866_2
NXP B.V. 2007. All rights reserved.
Product data sheet
Rev. 02 — 26 March 2007
3 of 28
NXP Semiconductors
SSTUA32866
1.8 V DDR2-667 congurable registered buffer with parity
Fig 2.
Parity logic diagram for 1 : 2 Register A conguration (positive logic); C0 = 0, C1 = 1
002aaa650
D
R
Q2A, Q3A,
Q5A, Q6A,
Q8A to Q14A
Q2B, Q3B,
Q5B, Q6B,
Q8B to Q14B
CLK
PAR_IN
D2, D3, D5, D6,
D8 to D14
CK
RESET
LPS0
(internal node)
CE
VREF
PARITY
CHECK
C1
0
1
D
R
CLK
D
R
CLK
CE
D
R
CLK
1
0
C0
R
CLK
D
R
CLK
LPS1
(internal node)
0
1
2-BIT
COUNTER
QERR
PPO
D2, D3, D5, D6,
D8 to D14
D2, D3, D5, D6,
D8 to D14
11
相关PDF资料 |
PDF描述 |
|---|---|
| SMP161040NS200{OHM}B | PASSIVE DELAY LINE, TRUE OUTPUT, PDSO16 |
| SMP141010NS200{OHM}C | PASSIVE DELAY LINE, TRUE OUTPUT, PDSO14 |
| SNC5437J | TTL/H/L SERIES, QUAD 2-INPUT NAND GATE, CDIP14 |
| SN74S74J-00 | S SERIES, DUAL POSITIVE EDGE TRIGGERED D FLIP-FLOP, COMPLEMENTARY OUTPUT, CDIP14 |
| SMP1610100NS200{OHM}B | PASSIVE DELAY LINE, TRUE OUTPUT, PDSO16 |
相关代理商/技术参数 |
参数描述 |
|---|---|
| SSTUA32866EC-G | 制造商:PHILIPS 制造商全称:NXP Semiconductors 功能描述:1.8 V 25-bit 1 : 1 or 14-bit 1 : 2 configurable registered buffer with parity for DDR2-667 RDIMM applications |
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| SSTUA32S865BHLFT | 功能描述:IC REGIST BUFF 25BIT DDR 160BGA RoHS:是 类别:集成电路 (IC) >> 逻辑 - 专用逻辑 系列:- 产品变化通告:Product Discontinuation 25/Apr/2012 标准包装:1,500 系列:74SSTV 逻辑类型:DDR 的寄存缓冲器 电源电压:2.3 V ~ 2.7 V 位数:14 工作温度:0°C ~ 70°C 安装类型:表面贴装 封装/外壳:48-TFSOP（0.240"，6.10mm 宽） 供应商设备封装:48-TSSOP 包装:带卷 (TR) |
| SSTUA32S865ET | 制造商:PHILIPS 制造商全称:NXP Semiconductors 功能描述:1.8 V 28-bit 1 : 2 registered buffer with parity for DDR2-667 RDIMM applications |
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